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參數(shù)資料
| 型號： | KXPC8240LVV200E |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 18/52頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MPU INTEGRATED 250MHZ 352TBGA |
| 標準包裝： | 2 |
| 系列： | MPC82xx |
| 處理器類型： | 32-位 MPC82xx PowerQUICC II |
| 速度： | 200MHz |
| 電壓： | 2.5V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 352-LBGA |
| 供應商設備封裝： | 352-TBGA（35x35） |
| 包裝： | 托盤 |
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MPC8240 Integrated Processor Hardware Specifications
25
Electrical and Thermal Characteristics
1.4.2.7
IEEE 1149.1 (JTAG) AC Timing Specifications
Table 15 provides the JTAG AC timing specifications for the MPC8240 while in the JTAG operating mode.
Figure 19 shows the JTAG clock input timing diagram.
Figure 19. JTAG Clock Input Timing Diagram
Table 15. JTAG AC Timing Specification (Independent of PCI_SYNC_IN)
Num
Characteristic 4
Min
Max
Unit
Notes
TCK frequency of operation
0
25
MHz
1
TCK cycle time
40
—
ns
2
TCK clock pulse width measured at 1.5 V
20
—
ns
3
TCK rise and fall times
0
3
ns
4TRST setup time to TCK falling edge
10
—
ns
1
5TRST assert time
10
—
ns
6
Input data setup time
5
—
ns
2
7
Input data hold time
15
—
ns
2
8
TCK to output data valid
0
30
ns
3
9
TCK to output high impedance
0
30
ns
3
10
TMS, TDI data setup time
5
—
ns
11
TMS, TDI data hold time
15
—
ns
12
TCK to TDO data valid
0
15
ns
13
TCK to TDO high impedance
0
15
ns
Notes:
1. TRST is an asynchronous signal. The setup time is for test purposes only.
2. Non-test (other than TDI and TMS) signal input timing with respect to TCK.
3. Non-test (other than TDO) signal output timing with respect to TCK.
4. Timings are independent of the system clock (PCI_SYNC_IN).
TCK
2
1
VM
3
VM = Midpoint Voltage
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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