Revision 10 1-25 Cell Timing Characteristics Figure 1-16 Flip-Flops (Positive edge triggered) D CLK CLR Q D CLK Q CLR
參數(shù)資料
型號： EX64-TQG64I
廠商： Microsemi SoC
文件頁數(shù)： 22/48頁
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描述： IC FPGA ANTIFUSE 3K 64-TQFP
標準包裝： 160
系列： EX
邏輯元件/單元數(shù)： 128
輸入/輸出數(shù)： 41
門數(shù)： 3000
電源電壓： 2.3 V ~ 2.7 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 85°C
封裝/外殼： 64-LQFP
供應商設備封裝： 64-TQFP（10x10）
eX Family FPGAs
Revision 10
1-25
Cell Timing Characteristics
Figure 1-16 Flip-Flops
(Positive edge triggered)
D
CLK
CLR
Q
D
CLK
Q
CLR
t HPWH,
tWASYN
tHD
t
HPWL
,
t
CLR
t
RPWL
t RPWH
PRESET
t PRESET
PRESET
t
HP
t SUD
tRCO
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PDF描述
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