參數(shù)資料
型號： EVAL-ADAU1761Z
廠商： Analog Devices Inc
文件頁數(shù)： 75/92頁
文件大?。?/td> 0K
描述： BOARD EVAL FOR ADAU1761
標準包裝： 1
系列： SigmaDSP®
主要目的： 音頻編解碼器
嵌入式： 是，DSP
已用 IC / 零件： ADAU1761
主要屬性： 立體聲，24 位，8 ~ 96 kHz 采樣率，GUI 工具
次要屬性： I²C 和 GPIO 接口，2 差分和 1 個立體聲單端模擬輸入和輸出
已供物品： 2 個板，線纜，CD
產品目錄頁面： 776 (CN2011-ZH PDF)
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ADAU1761BCPZ-R7-ND - IC SIGMADSP CODEC PLL 32LFCSP
ADAU1761BCPZ-ND - IC SIGMADSP CODEC PLL 32LFCSP
ADAU1761
Rev. C | Page 77 of 92
R38: DAC Control 2, 16,428 (0x402C)
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
RDAVOL[7:0]
Table 72. DAC Control 2 Register
Bits
Bit Name
Description
[7:0]
RDAVOL[7:0]
Controls the digital volume attenuation for right channel inputs from the right DAC. Each bit corresponds to a
0.375 dB step with slewing between settings. See Table 94 for a complete list of the volume settings.
Setting
Volume Attenuation
00000000
0 dB (default)
00000001
0.375 dB
00000010
0.75 dB
…
11111110
95.25 dB
11111111
95.625 dB
R39: Serial Port Pad Control, 16,429 (0x402D)
The optional pull-up/pull-down resistors are nominally 250 kΩ. When enabled, these pull-up/pull-down resistors set the serial port
signals to a defined state when the signal source becomes three-state.
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
ADCSDP[1:0]
DACSDP[1:0]
LRCLKP[1:0]
BCLKP[1:0]
Table 73. Serial Port Pad Control Register
Bits
Bit Name
Description
[7:6]
ADCSDP[1:0]
ADC_SDATA pad pull-up/pull-down configuration.
Setting
Configuration
00
Pull-up
01
Reserved
10
None (default)
11
Pull-down
[5:4]
DACSDP[1:0]
DAC_SDATA pad pull-up/pull-down configuration.
Setting
Configuration
00
Pull-up
01
Reserved
10
None (default)
11
Pull-down
[3:2]
LRCLKP[1:0]
LRCLK pad pull-up/pull-down configuration.
Setting
Configuration
00
Pull-up
01
Reserved
10
None (default)
11
Pull-down
[1:0]
BCLKP[1:0]
BCLK pad pull-up/pull-down configuration.
Setting
Configuration
00
Pull-up
01
Reserved
10
None (default)
11
Pull-down
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