參數(shù)資料
型號： EPF10K100EQI208-2
英文描述： Field Programmable Gate Array (FPGA)
中文描述： 現(xiàn)場可編程門陣列（FPGA）
文件頁數(shù)： 56/120頁
文件大小： 1901K
代理商： EPF10K100EQI208-2
40
Altera Corporation
FLEX 10KE Embedded Programmable Logic Family Data Sheet
Tables 12 and 13 summarize the ClockLock and ClockBoost parameters
for -1 and -2 speed-grade devices, respectively.
Table 12. ClockLock & ClockBoost Parameters for -1 Speed-Grade Devices
Symbol
Parameter
Condition
Min
Typ
Max
Unit
tR
Input rise time
5ns
tF
Input fall time
5ns
tINDUTY
Input duty cycle
40
60
%
fCLK1
Input clock frequency (ClockBoost
clock multiplication factor equals 1)
25
180
MHz
fCLK2
Input clock frequency (ClockBoost
clock multiplication factor equals 2)
16
90
MHz
fCLKDEV
Input deviation from user
specification in the MAX+PLUS II
software (ClockBoost clock
multiplication factor equals 1) (1)
25,000 (2)
PPM
tINCLKSTB
Input clock stability (measured
between adjacent clocks)
100
ps
tLOCK
Time required for ClockLock or
ClockBoost to acquire lock (3)
10
s
tJITTER
Jitter on ClockLock or ClockBoost-
generated clock (4)
tINCLKSTB < 100
250
ps
tINCLKSTB < 50
200 (4)
ps
tOUTDUTY
Duty cycle for ClockLock or
ClockBoost-generated clock
40
50
60
%
相關(guān)PDF資料
PDF描述
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EPF10K100EQI208-3DX ASIC
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參數(shù)描述
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