參數(shù)資料
型號： DS21FT44
廠商： MAXIM INTEGRATED PRODUCTS INC
元件分類： Digital Transmission Controller
英文描述： DATACOM, FRAMER, PBGA300
封裝： 27 X 27 MM, 1.27 MM PITCH, MCMBGA-300
文件頁數(shù)： 115/117頁
文件大?。?/td> 691K
代理商： DS21FT44
DS21FT44/DS21FF44
97 of 117
Figure 22-8. TRANSMIT SIDE BOUNDARY TIMING (With Elastic Store
Disabled)
Figure 22-9. TRANSMIT SIDE 1.544MHz BOUNDARY TIMING (With Elastic
Store Enabled)
LSB
MSB
CHANNEL 2
CHANNEL 1
TCHCLK
2
3
TCLK
TSYNC
TCHBLK 4
Don't Care
TLCLK
TLINK
Don't Care
5
A
Sa4
Sa5
Sa6
Sa7 Sa8
Notes:
1. There is a 5 TCLK delay from TSER to TPOS and TNEG
2. TSYNC is in the input mode (TCR1.0 = 0)
3. TSYNC is in the output mode (TCR1.0 = 1)
4. TCHBLK is programmed to block channel 2
5. TLINK is programmed to source the Sa4 bits
6. The signaling data at TSIG during channel 1 is normally overwritten in the transmit formatter with
the CAS multiframe alignment nibble (0000)
7. Shown is a non-align frame boundary
TPOS, TNEG
Si
1
CHANNEL 2
CHANNEL 1
TSIG
B
CD
A
BC
D
Note 6
LSB
MSB
LSB
MSB
A
Sa4
Sa5
Sa6
Sa7
Sa8
TSER
Si
1
CHANNEL 1
MSB
CHANNEL 32
1
TSER
LSB MSB
LSB
CHANNEL 1
TCHCLK
TCHBLK
TSYSCLK
TSSYNC
CHANNEL 23
CHANNEL 24
Notes:
1. TCHBLK is programmed to block channel 23
2. The F-bit position is ignored by the DS2154
1
MSB
F-Bit
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PDF描述
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參數(shù)描述
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