參數(shù)資料
型號： DS2151QN
廠商： Maxim Integrated Products
文件頁數(shù)： 33/60頁
文件大小： 0K
描述： IC TXRX T1 1-CH 5V LP IND 44PLCC
標(biāo)準(zhǔn)包裝： 1
功能： 單芯片收發(fā)器
接口： T1
電路數(shù)： 1
電源電壓： 4.75 V ~ 5.25 V
電流 - 電源： 65mA
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 44-LCC（J 形引線）
供應(yīng)商設(shè)備封裝： 44-PLCC（16.59x16.59）
包裝： 管件
包括： 警報檢測器和發(fā)生器，CSU 回路代碼發(fā)生器和檢測器，DSX-1和CSU 線路補償發(fā)生器
DS2151Q
39 of 60
13 LINE INTERFACE FUNCTIONS
The line interface function in the DS2151Q contains three sections: the receiver, which handles clock and
data recovery; the transmitter, which waveshapes and drives the T1 line; and the jitter attenuator. Each of
these three sections is controlled by the Line Interface Control Register (LICR), which is described
below.
LICR: LINE INTERFACE CONTROL REGISTER (Address = 7C Hex)
(MSB)
(LSB)
LB2
LB1
LB0
EGL
JAS
JABDS
DJA
TPD
LICR
SYMBOL
POSITION
NAME AND DESCRIPTION
LB2
LICR.7
Line Build-Out Select Bit 2. Sets the transmitter build
out; see the Table 13-2.
LB1
LICR.6
Line Build-Out Select Bit 1. Sets the transmitter build
out; see the Table 13-2.
LB0
LICR.5
Line Build-Out Select Bit 0. Sets the transmitter build
out; see the Table 13-2.
EGL
LICR.4
Receive Equalizer Gain Limit.
0 = -36dB
1 = -30dB
JAS
LICR.3
Jitter Attenuator Select.
0 = place the jitter attenuator on the receive side
1 = place the jitter attenuator on the transmit side
JABDS
LICR.2
Jitter Attenuator Buffer Depth Select.
0 = 128 bits
1 = 32 bits (use for delay sensitive applications)
DJA
LICR.1
Disable Jitter Attenuator.
0 = jitter attenuator enabled
1 = jitter attenuator disabled
TPD
LICR.0
Transmit Power Down.
0 = normal transmitter operation
1 = powers down the transmitter and tri-states the TTIP
and TRING pins
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PDF描述
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