參數(shù)資料
型號(hào)： DAC5674IPHPG4
廠商： Texas Instruments
文件頁(yè)數(shù)： 18/39頁(yè)
文件大小： 0K
描述： IC DAC 14BIT 400MSPS 48-HTQFP
產(chǎn)品培訓(xùn)模塊： Data Converter Basics
標(biāo)準(zhǔn)包裝： 250
系列： CommsDAC™
設(shè)置時(shí)間： 20ns
位數(shù)： 14
數(shù)據(jù)接口： 并聯(lián)
轉(zhuǎn)換器數(shù)目： 1
電壓電源： 模擬和數(shù)字
功率耗散（最大）： 550mW
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 48-TQFP 裸露焊盤
供應(yīng)商設(shè)備封裝： 48-HTQFP（7x7）
包裝： 托盤
輸出數(shù)目和類型： 2 電流，單極
采樣率（每秒）： 400M
配用： 296-30860-ND - EVAL MODULE FOR DAC5674
DAC5674
SLWS148A SEPTEMBER 2003 REVISED OCTOBER 2005
www.ti.com
25
Figure 29 shows an equivalent circuit for the clock input.
CLK
Internal
Digital In
CLKC
CLKGND
R1
10 k
AVDD
R1
10 k
R2
10 k
R2
10 k
AVDD
CLKVDD
Figure 29. Clock Input Equivalent Circuit
Figure 30, Figure 31, Figure 32, and Figure 33 show various input configurations for driving the differential
clock input (CLK/CLKC).
RT
200
CLK
1:4
CLKC
Termination Resistor
Swing Limitation
Optional, May Be Bypassed
for Sine Wave Input
CAC
0.1
F
Figure 30. Preferred Clock Input Configuration
Ropt
22
CLK
1:1
CLKC
Optional, Reduces
Clock Feedthrough
CAC
0.01
F
TTL/CMOS
Source
Ropt
22
CLK
CLKC
Node CLKC
Internally Biased
to IVDD 2
TTL/CMOS
Source
0.01
F
Figure 31. Driving the DAC5674 With a Single-Ended TTL/CMOS Clock Source
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