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參數(shù)資料
| 型號： | CH7004C |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Digital PC to TV Encoder with Macrovision |
| 中文描述： | 數(shù)碼電腦電視編碼器和通過Macrovision |
| 文件頁數(shù)： | 41/51頁 |
| 文件大小： | 336K |
| 代理商： | CH7004C |
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CHRONTEL
Register Descriptions
(continued)
CH7004C
201-0000-024 Rev 2.1, 8/2/99
41
Figure 26: Luma Transfer Function at different contrast enhancement settings
PLL Overflow Register
Symbol: MNE
Address: 13H
Bits: 5
The PLL Overflow Register contains the MSB bits for the ‘M’ and ‘N’ vlaues, which will be described in the PLL-
M and PLL-N registers, respectively. The reserved bits should not be written to.
PLL M Value Register
Symbol: PLLM
Address: 14H
Bits: 8
The PLL M value register determines the division factor applied to the frequency reference clock before it is input to
the PLL phase detector when the CH7004 is operating in master or pseudo-master clock mode. In slave mode, an
external pixel clock is used instead of the frequency reference, and the division factor is determined by the
XCM[3:0] value. This register contains the lower 8 bits of the complete 9-bit M value.
Bit:
7
6
5
4
Reserved
3
Reserved
2
N9
1
N8
0
M8
Symbol:
Type:
R/W
R/W
R/W
R/W
R/W
Default:
0
0
0
0
0
Bit:
Symbol:
7
M7
6
M6
5
M5
4
M4
3
M3
2
M2
1
M1
0
M0
Type:
Default:
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
0
1
0
0
0
0
0
1
0
32
64
96
128
160
192
224
256
0
32
64
96
128
160
192
224
256
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CH7004C-T | Digital PC to TV Encoder with Macrovision |
| CH7004C-V | Digital PC to TV Encoder with Macrovision |
| CH7007A | DIGITAL PC TO TV ENCODER WITH MACROVISION |
| CH7007A-T | DIGITAL PC TO TV ENCODER WITH MACROVISION |
| CH7007A-V | DIGITAL PC TO TV ENCODER WITH MACROVISION |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CH7004C-T | 制造商:CHRONTEL 功能描述: |
| CH7004C-V | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Digital PC to TV Encoder with Macrovision |
| CH7005C-T | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Digital PC to TV Encoder with Macrovision |
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| CH7006C | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Digital PC to TV Encoder Features |
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