參數(shù)資料
型號： ADUC7129BSTZ126
廠商： Analog Devices Inc
文件頁數(shù)： 78/92頁
文件大?。?/td> 0K
描述： IC DAS MCU ARM7 ADC/DDS 80-LQFP
產(chǎn)品培訓(xùn)模塊： Direct Digital Synthesis Tutorial Series (1 of 7): Introduction
標(biāo)準(zhǔn)包裝： 1
系列： MicroConverter® ADuC7xxx
核心處理器： ARM7
芯體尺寸： 16/32-位
速度： 41.78MHz
連通性： EBI/EMI，I²C，SPI，UART/USART
外圍設(shè)備： PLA，POR，PWM，PSM，溫度傳感器，WDT
輸入/輸出數(shù)： 38
程序存儲(chǔ)器容量： 126KB（63K x 16）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 8K x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 10x12b; D/A 1x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 125°C
封裝/外殼： 80-LQFP
包裝： 托盤
ADuC7128/ADuC7129
Rev. 0 | Page 8 of 92
TIMING SPECIFICATIONS
Table 2. External Memory Write Cycle
Parameter
Min
Typ
Max
Unit
CLK
UCLK
tMS_AFTER_CLKH
0
4
ns
tADDR_AFTER_CLKH
4
8
ns
tAE_H_AFTER_MS
CLK
tAE
(XMxPAR[14:12] + 1) × CLK
tHOLD_ADDR_AFTER_AE_L
CLK + (!XMxPAR[10]) × CLK
tHOLD_ADDR_BEFORE_WR_L
(!XMxPAR[8]) × CLK
tWR_L_AFTER_AE_L
CLK + (!XMxPAR[10] + !XMxPAR[8]) × CLK
tDATA_AFTER_WR_L
8
12
ns
tWR
(XMxPAR[7:4] + 1) × CLK
tWR_H_AFTER_CLKH
0
4
ns
tHOLD_DATA_AFTER_WR_H
(!XMxPAR[8]) × CLK
tBEN_AFTER_AE_L
CLK
tRELEASE_MS_AFTER_WR_H
(!XMxPAR[8] + 1) × CLK
060
20-
06
5
CLK
tMS_AFTER_CLKH
tAE_H_AFTER_MS
tAE
tWR_L_AFTER_AE_L
MS
AE
WS
RS
A/D[15:0]
FFFF
9ABC
5678
9ABE
1234
BLE
BHE
A16
tWR
tWR_H_AFTER_CLKH
tHOLD_DATA_AFTER_WR_H
tHOLD_ADDR_AFTER_AE_L
tHOLD_ADDR_BEFORE_WR_L
tDATA_AFTER_WR_L
tBEN_AFTER_AE_L
tADDR_AFTER_CLKH
tRELEASE_MS_AFTER_WR_H
Figure 3. External Memory Write Cycle
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PDF描述
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