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參數(shù)資料
| 型號： | ADSP-BF526KBCZ-4C2 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 11/36頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSP CTRLR 400MHZ 289CSPBGA |
| 標準包裝： | 1 |
| 系列： | Blackfin® |
| 類型： | 定點 |
| 接口： | DMA，以太網(wǎng)，I²C，PPI，SPI，SPORT，UART，USB |
| 時鐘速率： | 400MHz |
| 非易失內存： | ROM（32 kB） |
| 芯片上RAM： | 132kB |
| 電壓 - 輸入/輸出： | 1.8V，2.5V，3.3V |
| 電壓 - 核心： | 1.30V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 289-LFBGA，CSPBGA |
| 供應商設備封裝： | 289-CSPBGA（12x12） |
| 包裝： | 托盤 |
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ADSP-BF522C/ADSP-BF523C/ADSP-BF524C/ADSP-BF525C/ADSP-BF526C/ADSP-BF527C
Rev. A
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March 2010
Table 9. Register 5 Digital Audio Path
Bit Name
Bits
Description
Settings
HPOR
B4
Store dc offset when high-pass filter is disabled
0 = clear offset (default)
1 = store offset
DACMU
B3
DAC digital mute
0 = no mute (signal active)
1 = mute (default)
DEEMPH[1:0]
B[2:1]
De-emphasis control
00 = no de-emphasis (default)
01 = 32 kHz sampling rate
10 = 44.1 kHz sampling rate
11 = 48 kHz sampling rate
ADCHPD
B0
ADC high-pass filter control
0 = ADC high-pass filter enable (default)
1 = ADC high-pass filter disable
Table 10. Register 6 Power Management
Bit Name
Bits
Description
Settings
POWEROFF
B7
Whole chip power-down control
0 = power-up
1 = power-down (default)
CLKOUTPD
B6
Clock output power-down control
0 = power-up (default)
1 = power-down
OSCPD
B5
Crystal power-down control
0 = power-up (default)
1 = power-down
OUTPD
B4
Output power-down control
0 = power-up
1 = power-down (default)
DACPD
B3
DAC power-down control
0 = power-up
1 = power-down (default)
ADCPD
B2
ADC power-down control
0 = power-up
1 = power-down (default)
MICPD
B1
Microphone input power-down control
0 = power-up
1 = power-down (default)
LINEINPD
B0
Line input power-down control
0 = power-up
1 = power-down (default)
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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