參數(shù)資料
型號: AD9547BCPZ
廠商: Analog Devices Inc
文件頁數(shù): 71/104頁
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描述: IC CLOCK GEN/SYNCHRONIZR 64LFCSP
產(chǎn)品變化通告: AD9547 Mask Change 20/Oct/2010
標(biāo)準(zhǔn)包裝: 1
類型: 時(shí)鐘/頻率發(fā)生器,同步器
PLL:
主要目的: 以太網(wǎng),SONET/SDH,Stratum
輸入: CMOS,LVDS,LVPECL
輸出: CMOS,LVDS,LVPECL
電路數(shù): 1
比率 - 輸入:輸出: 2:2
差分 - 輸入:輸出: 是/是
頻率 - 最大: 750kHz
電源電壓: 1.71 V ~ 3.465 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 64-VFQFN 裸露焊盤,CSP
供應(yīng)商設(shè)備封裝: 64-LFCSP-VQ(9x9)
包裝: 托盤
Data Sheet
AD9547
Rev. E | Page 69 of 104
SYSTEM CLOCK (SYSCLK) (REGISTER 0x0100 TO REGISTER 0x0108)
Table 44. Charge Pump and Lock Detect Control
Address
Bit
Bit Name
Description
0x0100
7
External loop filter enable
Enables use of an external SYSCLK PLL loop filter.
0 (default) = internal loop filter.
1 = external loop filter.
6
Charge pump mode
Charge pump current control.
0 (default) = automatic.
1 = manual.
[5:3]
Charge pump current
Selects charge pump current when Bit 6 = 1.
000 = 125 μA.
001 = 250 μA.
010 = 375 μA.
011 (default) = 500 μA.
100 = 625 μA.
101 = 750 μA.
110 = 875 μA.
111 = 1000 μA.
2
Lock detect timer disable
Enable the SYSCLK PLL lock detect timer.
0 (default) = enable.
1 = disable.
[1:0]
Lock detect timer
Select lock detect timer depth.
00 (default) = 128.
01 = 256.
10 = 512.
11 = 1024.
Table 45. N Divider
Address
Bit
Bit Name
Description
0x0101
[7:0]
N divider
System clock PLL feedback divider value: 6 ≤ N ≤ 255 (default = 0x28 = 40).
Table 46. System Clock Input Options
Address
Bit
Bit Name
Description
0x0102
7
Unused
Unused.
6
M divider reset
Reset the M divider.
0 = normal operation.
1 (default) = reset.
When not using the M divider, program this bit to Logic 1.
[5:4]
M divider
System clock input divider.
00 (default) = 1.
01 = 2.
10 = 4.
11 = 8.
3
2× frequency multiplier
enable
Enable the 2× frequency multiplier.
0 (default) = disable.
1 = enable.
2
PLL enable
Enable the SYSCLK PLL.
0 = disable.
1 (default) = enable.
[1:0]
SYSCLK source
Input mode select for SYSCLKx pins.
00 = crystal resonator.
01 (default) = low frequency clock source.
10 = high frequency (direct) clock source.
11 = input receiver power-down.
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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AD9548 制造商:AD 制造商全稱:Analog Devices 功能描述:Quad/Octal Input Network Clock Generator/Synchronizer
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AD9548/PCBZ 制造商:Analog Devices 功能描述:Clock Generator Evaluation Board
AD9548BCPZ 功能描述:IC CLOCK GEN/SYNCHRONIZR 88LFCSP RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 專用 系列:- 標(biāo)準(zhǔn)包裝:1 系列:- 類型:時(shí)鐘/頻率發(fā)生器,多路復(fù)用器 PLL:是 主要目的:存儲器,RDRAM 輸入:晶體 輸出:LVCMOS 電路數(shù):1 比率 - 輸入:輸出:1:2 差分 - 輸入:輸出:無/是 頻率 - 最大:400MHz 電源電壓:3 V ~ 3.6 V 工作溫度:0°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:16-TSSOP(0.173",4.40mm 寬) 供應(yīng)商設(shè)備封裝:16-TSSOP 包裝:Digi-Reel® 其它名稱:296-6719-6