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參數(shù)資料
| 型號(hào)： | AD9211BCPZ-250 |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | ADC |
| 英文描述： | 10-Bit, 170/200/250 MSPS 1.8 V A/D Converter |
| 中文描述： | 1-CH 10-BIT PROPRIETARY METHOD ADC, PARALLEL ACCESS, QCC56 |
| 封裝： | 8 X 8 MM, ROHS COMPLIANT, MO-220VLLD-2, LFCSP-56 |
| 文件頁(yè)數(shù)： | 5/21頁(yè) |
| 文件大?。?/td> | 310K |
| 代理商： | AD9211BCPZ-250 |
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Preliminary Technical Data
AD9211
DIGITAL SPECIFICATIONS
Table 3 (AVDD = 1.8 V, DRVDD = 1.8 V, T
MIN
= –40°C, T
MAX
= +85°C, DCS Enabled unless otherwise noted.)
AD9211-170/-200
Parameter
Temp
Min
CLOCK INPUTS
Differential Input Voltage
1
Full
tbd
Common-Mode Voltage
2
Full
Input Resistance
Full
Input Capacitance
25°C
LOGIC INPUTS
Logic 1 Voltage
Full
.8 x VDD
Logic 0 Voltage
Full
Logic 1 Input Current
Full
Logic 0 Input Current
Full
Input Capacitance
25°C
LOGIC OUTPUTS
3
V
OD
Differential Output Voltage
Full
247
V
OS
Output Offset Voltage
Full
1.125
Output Coding
Twos Complement, or Binary
Rev. PrA | Page 5 of 21
AD9211-250
Typ
tbd
tbd
4
4
Unit
V
V
kΩ
pF
V
V
μA
μA
pF
mV
V
Typ
tbd
tbd
4
4
Max
.2 x AVDD
10
10
454
1.375
Min
tbd
2.0
247
1.125
Twos Complement, or Binary
Max
0.8
10
10
454
1.375
1
All ac specifications tested by driving CLK+ and CLK– differentially, |(CLK+)– (CLK–)| > 200 mV.
2
Clock inputs’ common mode can be externally set, such that xx.xV < (Clk+ or Clk- ) < zzz V.
3
LVDS R
Termination
= 100
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