Rev. 2.00 PIN CONFIGURATION Figure 2. XRD98L61 Pinout 37 38 39 40 41 42 43 44 45 46 47 48 1 2 3 4 5 6 7 8 9 10 11 12 24 23 22 21 20 " />
參數(shù)資料
型號(hào)： XRD98L61AIV-F
廠商： Exar Corporation
文件頁(yè)數(shù)： 12/38頁(yè)
文件大?。?/td> 0K
描述： IC CCD DIGITIZER 12BIT 48TQFP
標(biāo)準(zhǔn)包裝： 250
位數(shù)： 12
通道數(shù)： 1
電壓 - 電源，模擬： 2.7 V ~ 3.6 V
電壓 - 電源，數(shù)字： 2.7 V ~ 3.6 V
封裝/外殼： 48-TQFP
供應(yīng)商設(shè)備封裝： 48-TQFP（7x7）
包裝： 托盤(pán)
XRD98L61
2
Rev. 2.00
PIN CONFIGURATION
Figure 2. XRD98L61 Pinout
37
38
39
40
41
42
43
44
45
46
47
48
1
2 3
4 5
6
7 8
9 10 11 12
24
23
22
21
20
19
18
17
16
15
14
13
36 35 34 33 32 31 30 29 28 27 26 25
XRD98L61
ADCinP
DB8
DB10
DB11
DB9
OVER
AVDD
AGND
ExtRef
ADCinN
CapN
CapP
AV
DD
DAC0
DAC1
AGND
Test2
Test1
AV
DD
CCDin
REFin
AGND
RESET
PD
CLAMP
SBLK
SPIX
ADCLK
DVDD
DGND
AVDD
AGND
SCLK
LOAD
SDI
OE
DB7
DB6
DB5
OGND
OV
DD
DB4
DB3
DB2
DB1
DB0
Test3
CAL
Figure 1. XRD98L61 Block Diagram
CDS
12-bit ADC
Digital Noise
Suppression Filter
CDAC
FDAC
Offset Calibration
Logic
Reg
OVER
DB[11:0]
REFin
Test2
ADCinP
ADCinN
PGA[9:0]
AVDD
AGND
OVDD
OGND
DVDD
DGND
Serial
Interface
Timing
Logic
SDI
SCLK
LOAD
Fsync
CLAMP
CAL
SPIX
SBLK
ADCLK
Bias
ExtRef
CapN
8 bit
DAC
8 bit
DAC
DAC0
DAC1
PD
RESET
OE
Readback data
to output mux
Readback data
from Serial Interface
RBenable
CCDin
+
PGA
CapP
Test1
Black Level
Offset Calibration
Loop
PGA[9:0]
Manual
DAC
Control
Rext
DGND
DVDD
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