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參數(shù)資料
| 型號： | XC705B32CFNE |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 8/302頁 |
| 文件大小： | 0K |
| 描述： | IC MCU 2.1MHZ 32K OTP 52-PLCC |
| 標(biāo)準(zhǔn)包裝： | 23 |
| 系列： | HC05 |
| 核心處理器： | HC05 |
| 芯體尺寸： | 8-位 |
| 速度： | 2.1MHz |
| 連通性： | SCI |
| 外圍設(shè)備： | POR，WDT |
| 輸入/輸出數(shù)： | 32 |
| 程序存儲器容量： | 32KB（32K x 8） |
| 程序存儲器類型： | OTP |
| EEPROM 大?。?/td> | 256 x 8 |
| RAM 容量： | 528 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 4.5 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x8b; D/A 2x8b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 52-LCC（J 形引線） |
| 包裝： | 管件 |
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MC68HC05B6
Rev. 4.1
Freescale
9-1
RESETS AND INTERRUPTS
9
RESETS AND INTERRUPTS
9.1
Resets
The MC68HC05B6 can be reset in three ways: by the initial power-on reset function, by an active
low input to the RESET pin or by a computer operating properly (COP) watchdog reset. Any of
these resets will cause the program to go to its starting address, specified by the contents of
memory locations $1FFE and $1FFF, and cause the interrupt mask bit in the condition code
register to be set.
Figure 9-1 Reset timing diagram
VDD
RESET
1FFF
1FFE
New
1FFF
1FFE
PC
OSC1
New
PC
Internal
processor clock
1FFE
Op
code
New
PCL
New
PCH
tVDDR
Op
code
New
PCL
New
PCH
address bus
Internal
data bus
tOXOV
tCYC
tPORL
1FFE
Program
execution
begins
Program
execution
begins
tRL(or tDOGL)
(Internal power-on reset)
(External hardware reset)
VDD threshold (1-2V typical)
Reset sequence
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 5504407-1 | ADAPTER FC STD PHOS/BRZ |
| VI-B4F-CU-F4 | CONVERTER MOD DC/DC 72V 200W |
| 2-5502632-1 | CONN RCPT COUPLING SIMPLEX GREEN |
| VI-B4F-CU-F3 | CONVERTER MOD DC/DC 72V 200W |
| MC908EY8ACFJE | IC MCU 8K FLASH 8MHZ 32-LQFP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XC708KH12IFUE | 制造商:Freescale Semiconductor 功能描述: |
| XC708KH12PBE | 制造商:Freescale Semiconductor 功能描述: |
| XC711EA9CFNE | 制造商:Freescale Semiconductor 功能描述: |
| XC7272A-25PC84C | 制造商:Xilinx 功能描述: |
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