參數(shù)資料
型號: XC705B32CFNE
廠商: Freescale Semiconductor
文件頁數(shù): 4/302頁
文件大?。?/td> 0K
描述: IC MCU 2.1MHZ 32K OTP 52-PLCC
標準包裝: 23
系列: HC05
核心處理器: HC05
芯體尺寸: 8-位
速度: 2.1MHz
連通性: SCI
外圍設(shè)備: POR,WDT
輸入/輸出數(shù): 32
程序存儲器容量: 32KB(32K x 8)
程序存儲器類型: OTP
EEPROM 大?。?/td> 256 x 8
RAM 容量: 528 x 8
電壓 - 電源 (Vcc/Vdd): 4.5 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器: A/D 8x8b; D/A 2x8b
振蕩器型: 內(nèi)部
工作溫度: -40°C ~ 85°C
封裝/外殼: 52-LCC(J 形引線)
包裝: 管件
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MC68HC05B6
Rev. 4.1
Freescale
8-3
ANALOG TO DIGITAL CONVERTER
8
8.2
A/D registers
8.2.1
Port D data register (PORTD)
Port D is an input-only port which routes the eight analog inputs to the A/D converter. When the
A/D converter is disabled, the pins are configured as standard input-only port pins, which can be
read via the port D data register.
Note:
When the A/D function is enabled, pins PD0–PD7 will act as analog inputs. Using a pin
or pins as A/D inputs does not affect the ability to read port D as static inputs; however,
reading port D during an A/D conversion sequence may inject noise on the analog
inputs and result in reduced accuracy of the A/D result.
Performing a digital read of port D with levels other than VDD or VSS on the pins will
result in greater power dissipation during the read cycle, and may give unpredictable
results on the corresponding port D pins.
8.2.2
A/D result data register (ADDATA)
ADDATA is a read-only register which is used to store the results of A/D conversions. Each result
is loaded into the register from the SAR and the conversion complete flag, COCO, in the ADSTAT
register is set.
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
Port D data (PORTD)
$0003
PD7
PD6
PD5
PD4
PD3
PD2
PD1
PD0
Undefined
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
A/D data (ADDATA)
$0008
0000 0000
相關(guān)PDF資料
PDF描述
5504407-1 ADAPTER FC STD PHOS/BRZ
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參數(shù)描述
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