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參數(shù)資料
| 型號(hào)： | uPD72107L |
| 廠商： | NEC Corp. |
| 英文描述： | LAP-B CONTROLLER(Link Access Procedure Balanced mode) |
| 中文描述： | 鱲- B控制器（鏈路訪問過程平衡模式） |
| 文件頁數(shù)： | 19/32頁 |
| 文件大小： | 182K |
| 代理商： | UPD72107L |
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19
μ
PD72107
Serial block (1)
Parameter
Symbol
Conditions
MIN.
MAX.
Unit
TxC/RxC cycle time
t
CYS
When on-chip DPLL is not used
250
DC
ns
TxC/RxC low-level time
t
SSL
110
ns
TxC/RxC high-level time
t
SSH
110
ns
TxC/RxC rise time
t
SR
20
ns
TxC/RxC fall time
t
SF
12
ns
TxD delay time (vs. TxC
↓
)
t
DTXD
100
ns
RxD setup time (vs. RxC
↑
)
t
SRXD
50
ns
RxD hold time (vs. RxC
↑
)
t
HRXD
70
ns
Serial clock (when on-chip DPLL is not used)
t
SF
t
SR
t
SSL
0.8 V
2.2 V
t
SSH
t
CYS
t
DTXD
t
DTXD
t
SRXD
t
HRXD
TxC/RxC
TxC (input)
TxD
RxC
RxD
相關(guān)PDF資料 |
PDF描述 |
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