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參數資料
| 型號： | UPD70F3116GJA-UEN |
| 廠商： | NEC Corp. |
| 英文描述： | 32-Bit Single-Chip Microcontrollers |
| 中文描述： | 32位單芯片微控制器 |
| 文件頁數： | 177/826頁 |
| 文件大?。?/td> | 3455K |
| 代理商： | UPD70F3116GJA-UEN |
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CHAPTER 7 INTERRUPT/EXCEPTION PROCESSING FUNCTION
177
User’s Manual U14492EJ5V0UD
7.3.7 Maskable interrupt status flag (ID)
The ID flag is bit 5 of the PSW and this controls the maskable interrupt’s operating state, and stores control
information regarding enabling or disabling of interrupt requests.
31
0
PSW
Initial value
00000020H
7
NP
6
EP
5
ID
4
SAT
3
CY
2
OV
1
S Z
8
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
Bit position
Bit name
Function
5
ID
Indicates whether maskable interrupt servicing is enabled or disabled.
0: Maskable interrupt request acknowledgment enabled
1: Maskable interrupt request acknowledgment disabled (pending)
This bit is set to 1 by the DI instruction and reset to 0 by the EI instruction. Its
value is also modified by the RETI instruction or LDSR instruction when
referencing the PSW.
Non-maskable interrupt requests and exceptions are acknowledged regardless
of this flag. When a maskable interrupt is acknowledged, the ID flag is
automatically set to 1 by hardware.
The interrupt request generated during the acknowledgment disabled period (ID
= 1) is acknowledged when the xxIFn bit of xxICn register is set to 1, and the ID
flag is reset to 0.
7.3.8 Interrupt trigger mode selection
The valid edge of the INTPn, ADTRG0, ADTRG1, TIUD10, TIUD11, TCUD10, TCUD11, TCLR10, TCLR11,
TCLR3, and TI3 pins can be selected by program. The edge that can be selected as the valid edge is one of the
following (n = 0 to 6, 20 to 25, 30, 31, 100, 101, 110, 111).
Rising edge
Falling edge
Both the rising and falling edges
When the INTPn, ADTRG0, ADTRG1, TIUD10, TIUD11, TCUD10, TCUD11, TCLR10, TCLR11, TCLR3, and TI3
signals are edge-detected, they become an interrupt source or capture/trigger.
The valid edge is specified by external interrupt mode registers 1 and 2 (INTM1 and INTM2), signal edge selection
registers 10 and 11 (SESA10 and SESA11), the valid edge selection register (SESC), and TM2 input filter mode
registers 0 to 5 (FEM0 to FEM5).
相關PDF資料 |
PDF描述 |
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參數描述 |
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| UPD70F3134A | 制造商:NEC 制造商全稱:NEC 功能描述:32-Bit Single-Chip Microcontrollers |
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