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參數(shù)資料
| 型號： | UPD44165184F5-E50-EQ1 |
| 廠商： | NEC Corp. |
| 英文描述： | 18M-BIT QDRII SRAM 4-WORD BURST OPERATION |
| 中文描述： | 1800萬位推出QDRII SRAM的4個字爆發(fā)運作 |
| 文件頁數(shù)： | 12/32頁 |
| 文件大?。?/td> | 392K |
| 代理商： | UPD44165184F5-E50-EQ1 |
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12
Data Sheet M15825EJ7V
1
DS
μ
PD44165084, 44165184, 44165364
DC Characteristics (T
A
= 0 to 70°C, V
DD
= 1.8 ± 0.1 V)
Parameter
Symbol
Test condition
MIN.
TYP.
MAX.
Unit
Note
x8, x18 x36
Input leakage current
I
LI
–2
–
+2
μ
A
I/O leakage current
I
LO
–2
–
+2
μ
A
Operating supply current
I
DD
V
IN
≤
V
IL
or V
IN
≥
V
IH
, –E40
650
–
mA
(Read Write cycle)
I
I/O
= 0 mA
–E50
550
650
Cycle = MAX.
–E60
480
570
Standby supply current
I
SB1
V
IN
≤
V
IL
or V
IN
≥
V
IH
, –E40
320
–
mA
(NOP)
I
I/O
= 0 mA
–E50
270
Cycle = MAX.
–E60
250
High level output voltage
V
OH(Low)
|I
OH
|
≤
0.1 mA
V
DD
Q
– 0.2
–
V
DD
Q
V
3,4
V
OH
Note1
V
DD
Q/2 – 0.12
–
V
DD
Q/2 + 0.12
3,4
Low level output voltage
V
OL(Low)
I
OL
≤
0.1 mA
V
SS
–
0.2
V
3,4
V
OL
Note2
V
DD
Q/2 – 0.12
–
V
DD
Q/2 + 0.12
3,4
Notes 1.
Outputs are impedance-controlled. | I
OH
| = (V
DD
Q/2)/(RQ/5) for values of 175
≤
RQ
≤
350
.
2.
Outputs are impedance-controlled. I
OL
= (V
DD
Q/2)/(RQ/5) for values of 175
≤
RQ
≤
350
.
3.
AC load current is higher than the shown DC values.
4.
HSTL outputs meet JEDEC HSTL Class I and Class II standards.
Capacitance (T
A
= 25
°
C, f = 1MHz)
Parameter
Symbol
Test conditions
MIN.
TYP.
MAX.
Unit
Input capacitance(Address, Control)
C
IN
V
IN
= 0 V
4
5
pF
Input / Output capacitance(D, Q)
C
I/O
V
I/O
= 0 V
6
7
pF
Clock Input capacitance
C
clk
V
clk
= 0 V
5
6
pF
Remark
These parameters are periodically sampled and not 100% tested.
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