參數(shù)資料
型號(hào): TMX320C6414TGLZ
廠商: Texas Instruments, Inc.
元件分類: 數(shù)字信號(hào)處理
英文描述: FIXED-POINT DIGITAL SIGNAL PROCESSORS
中文描述: 定點(diǎn)數(shù)字信號(hào)處理器
文件頁(yè)數(shù): 68/140頁(yè)
文件大?。?/td> 2033K
代理商: TMX320C6414TGLZ
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SPRS226H NOVEMBER 2003 REVISED AUGUST 2005
68
POST OFFICE BOX 1443
HOUSTON, TEXAS 772511443
clock PLL (continued)
Table 31. TMS320C64x PLL Multiply Factor Options, Clock Frequency Ranges, and Typical Lock Time
GLZ and ZLZ PACKAGES 23 x 23 mm BGA
CLKMODE1
CLKMODE0
CLKMODE
(PLL MULTIPLY
FACTORS)
CLKIN
RANGE
(MHz)
CPU CLOCK
FREQUENCY
RANGE (MHz)
CLKOUT4
RANGE (MHz)
CLKOUT6
RANGE (MHz)
TYPICAL
LOCK TIME
(
μ
s)§
N/A
0
0
Bypass (x1)
0100
0100
025
016.6
0
1
x6
4275
252450
63112.5
4275
1
1
0
1
x12
x20
4275
2550
504900
5001000
126225
125250
84150
83.3166.6
75
These clock frequency range values are applicable to a C64x600, 720, 850, and 1000-MHz speed devices. For more detailed information,
see the CLKIN timing requirements table for the specific device speed.
Use external pullup resistors on the CLKMODE pins (CLKMODE1 and CLKMODE0) to set the C64x device to one of the valid PLL multiply clock
modes (x6, x12, or x20). With internal pulldown resistors on the CLKMODE pins (CLKMODE1, CLKMODE0), the default clock mode is
x1 (bypass).
§Under some operating conditions, the maximum PLL lock time may vary by as much as 150% from the specified typical value. For example, if
the typical lock time is specified as 100
μ
s, the maximum value may be as long as 250
μ
s.
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PDF描述
TMX320C6415TGLZ FIXED-POINT DIGITAL SIGNAL PROCESSORS
TMXF28155 155/51 Mbits/s SONET/SDH(155/51 M位/秒 SONET/SDH)
TN28F001BX-T150 1-MBIT (128K x 8) BOOT BLOCK FLASH MEMORY
TN28F001BX-T90 1-MBIT (128K x 8) BOOT BLOCK FLASH MEMORY
TN28F001BX-B150 1-MBIT (128K x 8) BOOT BLOCK FLASH MEMORY
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