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參數(shù)資料
| 型號(hào)： | TMS320F28044ZGMS |
| 廠商： | Texas Instruments, Inc. |
| 元件分類(lèi)： | 數(shù)字信號(hào)處理 |
| 英文描述： | Digital Signal Processor |
| 中文描述： | 數(shù)字信號(hào)處理器 |
| 文件頁(yè)數(shù)： | 59/107頁(yè) |
| 文件大?。?/td> | 784K |
| 代理商： | TMS320F28044ZGMS |
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www.ti.com
S
SPICTL.0
SPI INT FLAG
SPI INT
ENA
SPISTS.6
S
Clock
Polarity
Talk
SPICTL.1
LSPCLK
4
5
6
1
2
3
0
0
1
2
3
SPI Bit Rate
State Control
SPIRXBUF
Buffer Register
Clock
Phase
Receiver
Overrun Flag
SPICTL.4
Overrun
INT ENA
SPICCR.3 0
SPIBRR.6 0
SPICCR.6
SPICTL.3
SPIDAT.15 0
M
S
M
Master/Slave
SPISTS.7
SPIDAT
Data Register
M
S
SPICTL.2
SPI Char
SPISIMO
SPISOMI
SPICLK
SW2
S
M
M
S
SW3
To CPU
M
SW1
SPITXBUF
Buffer Register
RX FIFO _0
RX FIFO _15
16
TX FIFO registers
TX FIFO _0
16
TX FIFO _15
RX FIFO registers
16
16
TX Interrupt
Logic
RX Interrupt
Logic
SPIINT/SPIRXINT
SPITXINT
SPIFFOVF FLAG
SPIFFRX.15
TX FIFO Interrupt
RX FIFO Interrupt
SPIRXBUF
SPITXBUF
SPIFFTX.14
SPIFFENA
SPISTE
(A)
TMS320F28044
Digital Signal Processor
SPRS357B–AUGUST 2006–REVISED MAY 2007
Figure 4-9
is a block diagram of the SPI in slave mode.
A.
SPISTE is driven low by the master for a slave device.
Figure 4-9. SPI Module Block Diagram (Slave Mode)
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Peripherals
59
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