參數(shù)資料
型號(hào)： TMP91FW60FG
元件分類： 微控制器/微處理器
英文描述： MICROCONTROLLER, PQFP100
封裝： 14 X 14 MM, 0.50 MM PITCH, LEAD FREE, PLASTIC, LQFP-44
文件頁數(shù)： 231/322頁
文件大小： 4595K
代理商： TMP91FW60FG
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Page 302
2007-10-15
TMP91FW60
Symbol
Name
Address
7
6
5
4
3
2
1
0
SC2BUF
Serial
channel 2
buffer
210H
(RMW instruc-
tions are pro-
hibited.)
RB7 / TB7
RB6 / TB6
RB5 / TB5
RB4 / TB4
RB3 / TB3
RB2 / TB2
RB1 / TB1
RB0 / TB0
R (Receiving) / W (Transmission)
Undefined
SC2CR
Serial
channel 2
control
211H
(RMW instruc-
tions are pro-
hibited.)
RB8
EVEN
PE
OERR
PERR
FERR
SCLKS
IOC
R
R/W
R (Cleared to "0" when read)
R/W
Undefined
0
Received
data bit8
Parity
0: Odd
1: Even
Parity
addition
0: Disable
1: Enable
Overrun
error flag
0: Unde-
tect error
1: Detect
error
Parity error
flag
0: Unde-
tect error
1: Detect
error
Framing
error flag
0: Unde-
tect error
1: Detect
error
Edge
selection
for SCLK
pin (I/O
mode)
0: SCLK
↑
1: SCLK
↓
I/O inter-
face input
clock
selection
0: Baud
rate gener-
ator
1: SCLK
pin input
SC2MOD0
Serial
channel 2
mode 0
212H
TB8
CTSE
RXE
WU
SM1
SM0
SC1
SC0
R/W
0
000
0
Transmis-
sion data
bit8
Hand-
shake
function
0: Disable
1: Enable
Receive
function
0: Disable
1: Enable
Wakeup
function
0: Disable
1: Enable
Serial transmission
mode
00: I/O interface mode
01: 7-bit UART mode
10: 8-bit UART mode
11: 9-bit UART mode
Serial transmission clock
(UART)
00: Timer TA0TRG
01: Baud rate generator
10: Internal clock fSYS
11: External clock
(SCLK input)
BR2CR
Baud ratel
control
213H
–
BR2ADDE
BR2CK1
BR2CK0
BR2S3
BR2S2
BR2S1
BR2S0
R/W
0
000
0
Always
write “0”.
+ (16 - K)/
16 division
0: Disable
1: Enable
Input clock selection for
baud rate generator
00:
φT0
01:
φT2
10:
φT8
11:
φT32
Setting of the divided frequency “N”
BR2ADD
Serial
channel 2
K setting
register
214H
–
BR2K3
BR2K2
BR2K1
BR2K0
–
–––
R/W
–
–––
000
0
–
–––
Sets frequency divisor “K”
(Divided by N + (16 - K)/16)
SC2MOD1
Serial
channel 2
mode 1
215H
I2S2
FDPX2
–
R/W
–
–––
–
0
0––
–––
–
IDLE2
0: Stop
1: Run
Duplex
0: Half
1: Full
––
–––
–
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