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參數(shù)資料
| 型號： | STM32W108CBU62 |
| 廠商： | STMICROELECTRONICS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, QCC48 |
| 封裝： | 7 X 7 MM, ROHS COMPLIANT, VFQFPN-48 |
| 文件頁數(shù)： | 192/208頁 |
| 文件大?。?/td> | 2801K |
| 代理商： | STM32W108CBU62 |
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Serial interfaces
STM32W108CB, STM32W108HB
Doc ID 16252 Rev 6
9.6.1
Setup and configuration
The UART baud rate clock is produced by a programmable baud generator starting from the
24 Hz clock:
The integer portion of the divisor, N, is written to the SC1_UARTPER register and the
fractional part, F, to the SC1_UARTFRAC register. Table 21 shows the values used to
generate some common baud rates and their associated clock frequency error. The UART
requires an internal clock that is at least eight times the baud rate clock, so the minimum
allowable setting for SC1_UARTPER is ‘8’.
Note:
The UART may receive corrupt bytes if the interbyte gap is long or there is a baud rate
mismatch between receive and transmit. The UART may detect a parity and/or framing error
on the corrupt byte, but there will not necessarily be any error detected. As a result, the
device should be operated in systems where the other side of the communication link also
uses a crystal as its timing reference, and baud rates should be selected to minimize the
baud rate mismatch to the crystal tolerance. UART protocols should contain some form of
error checking (e.g. CRC) at the packet level to detect, and retry in the event of errors.
The UART character frame format is determined by three bits in the SC1_UARTCFG
register:
●
SC1_UART2STP selects the number of stop bits in transmitted characters. (Only one
stop bit is ever required in received characters.) If this bit is clear, characters are
transmitted with one stop bit; if set, characters are transmitted with two stop bits.
●
SC1_UARTPAR controls whether or not received and transmitted characters include a
parity bit. If SC1_UARTPAR is clear, characters do not contain a parity bit, otherwise,
characters do contain a parity bit.
●
SC1_UARTODD specifies whether transmitted and received parity bits contain odd or
even parity. If this bit is clear, the parity bit is even, and if set, the parity bit is odd. Even
parity is the exclusive-or of all of the data bits, and odd parity is the inverse of the even
parity value. SC1_UARTODD has no effect if SC1_UARTPAR is clear.
Table 21.
UART baud rate divisors for common baud rates
Baud rate (bits/sec)
SC1_UARTPER
SC1_UARTFRAC
Baud rate error (%)
300
40000
0
2400
5000
0
4800
2500
0
9600
1250
0
19200
625
0
38400
312
1
0
57600
208
1
- 0.08
115200
104
0
+ 0.16
230400
52
0
+ 0.16
460800
26
0
+ 0.16
921600
13
0
+ 0.16
F
N
MHz
baud
+
=
2
24
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