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參數(shù)資料
| 型號： | STM32W108CBU62 |
| 廠商： | STMICROELECTRONICS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, QCC48 |
| 封裝： | 7 X 7 MM, ROHS COMPLIANT, VFQFPN-48 |
| 文件頁數(shù)： | 139/208頁 |
| 文件大?。?/td> | 2801K |
| 代理商： | STM32W108CBU62 |
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System modules
STM32W108CB, STM32W108HB
Doc ID 16252 Rev 6
Deep sleep reset
The Power Management module informs the Reset Generation module of entry into and exit
from the deep sleep states. The deep sleep reset is applied in the following states: before
entry into deep sleep, while removing power from the memory and core domain, while in
deep sleep, while waking from deep sleep, and while reapplying power until reliable power
levels have been detect by POR LV.
The Power Management module allows a special emulated deep sleep state that retains
memory and core domain power while in deep sleep.
6.2.2
Reset recording
The STM32W108 records the last reset condition that generated a restart to the system.
The reset conditions recorded are:
●
POWER_HV
Always-on domain power supply failure
●
POWER_LV
Core or memory domain power supply failure
●
RSTB
NRST pin asserted
●
W_DOG
Watchdog timer expired
●
SW_RST
Software reset by SYSERSETREQ from ARM Cortex-M3
CPU
●
WAKE_UP_DSLEEP
Wake-up from deep sleep
●
OPT_BYTE_FAIL
Error check failed when reading option bytes from Flash
memory
The Reset event source register (RESET_EVENT) is used to read back the last reset event.
All bits are mutually exclusive except the OPT_BYTE_FAIL bit which preserves the original
reset event when set.
Note:
While CPU Lockup is marked as a reset condition in software, CPU Lockup is not
specifically a reset event. CPU Lockup is set to indicate that the CPU entered an
unrecoverable exception. Execution stops but a reset is not applied. This is so that a
debugger can interpret the cause of the error. We recommend that in a live application (i.e.
no debugger attached) the watchdog be enabled by default so that the STM32W108 can be
restarted.
6.2.3
Reset generation
The Reset Generation module responds to reset sources and generates the following reset
signals:
●
PORESET
Reset of the ARM Cortex-M3 CPU and ARM Cortex-M3
System Debug components (Flash Patch and Breakpoint,
Data Watchpoint and Trace, Instrumentation Trace Macrocell,
Nested Vectored Interrupt Controller). ARM defines
PORESET as the region that is reset when power is applied.
●
SYSRESET
Reset of the ARM Cortex-M3 CPU without resetting the
Core Debug and System Debug components, so that a live
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