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參數(shù)資料
| 型號(hào)： | RH80530NZ004256 |
| 英文描述： | MICROPROCESSOR|32-BIT|CMOS|PGA|478PIN|CERAMIC |
| 中文描述： | 微處理器| 32位|的CMOS |美巡賽| 478PIN |陶瓷 |
| 文件頁數(shù)： | 43/89頁 |
| 文件大小： | 1672K |
| 代理商： | RH80530NZ004256 |
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Mobile Intel
Pentium
III Processor-M Datasheet
298340-002
Datasheet
43
Figure 10. Setup and Hold Timings
CLK
Sgna
V Vaid
T
h
Ts
D0005-00
Vc
NOTES
:
T
s
= T8, T12, T27 (Setup Time)
T
h
= T9, T13, T28 (Hold Time)
V = V
REF
for AGTL signals; 1.0V for CMOS, APIC, and TAP signals
Vc = Crossing point of BCLK rising edge and BCLK# falling edge for BCLK references (Differential Clock)
= 1
.25V (Single Ended Clock)
Figure 11. Cold/Warm Reset and Configuration Timings
BCLK
RESET#
T
v
T
x
T
t
T
u
V
C
V
D0006-02
Configuration
(A[15:5], BREQ0#,
FLUSH#, INIT#,
PICD0)
T
w
Valid
PICD[1:0]
AGTL/non-AGTL
outputs
Non-configuration
inputs
T
y
Valid
T
z
Active
NOTES
:
T
t
= T9 (AGTL Input Hold Time)
T
u
= T8 (AGTL Input Setup Time)
T
v
= T10 (RESET# Pulse Width)
T
w
= T16 (Reset Configuration Signals (A[15:5]#, BREQ0#, FLUSH#, INIT#, PICD0) Setup Time)
T
x
= T17 (Reset Configuration Signals (A[15:5]#, BREQ0#, FLUSH#, INIT#, PICD0) Hold Time)
T
y
= T18D (RESET# inactive to Valid Outputs)
T
z
= T18E (RESET# inactive to Drive Signals)
Vc= Crossing point of BCLK rising edge and BCLK# falling edge (Differential Clock)
= 1.25V (Single Ended Clock)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| RH80530NZ006256 | MICROPROCESSOR|32-BIT|CMOS|PGA|478PIN|CERAMIC |
| RH80530NZ009256 | MICROPROCESSOR|32-BIT|CMOS|PGA|478PIN|CERAMIC |
| RH80530WZ014256 | Microprocessor |
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| RJ80530LZ800512 | Microprocessor |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| RH80530NZ009256 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:MICROPROCESSOR|32-BIT|CMOS|PGA|478PIN|CERAMIC |
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| RH80530NZ014256 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| RH80530WZ004256 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
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