參數(shù)資料
型號： PEF22554HT
廠商： INFINEON TECHNOLOGIES AG
元件分類： 數(shù)字傳輸電路
英文描述： DATACOM, FRAMER, PQFP144
封裝： GREEN, PLASTIC, LBGA-160
文件頁數(shù)： 685/700頁
文件大?。?/td> 25742K
代理商： PEF22554HT
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Data Sheet
85
Rev. 1.2, 2006-01-26
QuadFALC
TM
PEF 22554 E
Functional Description E1/T1/J1
3
Functional Description E1/T1/J1
3.1
Compatibility
To ensure an easy transition from QuadFALC
TM V2.1 to QuadFALCTM V3.1 designs, software written for the
QuadFALC
TM V2.1 can be used for the v3.1 without changes and hardware compatibility is supported. Board
space is saved by using a P/PG-LBGA-160-1 package.
3.1.1
Software Compatibility
The QuadFALC
TM device contains analog and digital function blocks that are configured and controlled by an
external microprocessor or micro controller, using either the asynchronous interface, SPI bus or SCI bus.
The QuadFALC
TM Version 3.1 can be used in two basic modes.
The “Compatibility Mode” option (GPC6.COMP_DIS = 0
B) ensures an easy transition of designs from
QuadFALC
Version 2.1 to QuadFALCTM Version 3.1, software written for the QuadFALC version V2.1 can
be used for the QuadFALC
TM Version 3.1 without changes.
The “Generic Mode” option (GPC6.COMP_DIS = 1
B) offers additionally a more flexible configuration of the
clock system where additional registers are used, see Table 65.
As in the QuadFALC
TM Version 2.1 the register addresses are always 10 bit wide.
If compatibility mode is selected, the version status register VSTR shows the same value as in QuadFALC
V2.1
while the JTAG boundary scan ID is always the QuadFALC
TM Version 3.1 number and not affected by the mode
selection. In compatibility mode the behavior of the clocking system is the same as in the QuadFALC
V2.1. The
multi function pin RPC has the function RCLK after reset (Register bits PC1.RPC(3:0)).
The SPI bus or SCI bus can be used also in compatibility mode.
All of the additional features except the more flexible configuration of the clock systerm are available also in
compatibility mode, but are disabled by default and must be activated by software.
3.1.2
Hardware Compatibility
The QuadFALC
TM Version 3.1 is hardware and pin compatibel to the QuadFALCTM Version 2.1.
The QuadFALC
TM requires two supply voltages, 1.8 V and 3.3 V, see Figure 8. For compatibility reasons, it is
possible to operate the device off a single 3.3 V supply, with the 1.8 V supply being generated internally by an on-
chip regulator, see Figure 7. In order to minimize power dissipation, it is recommended to operate the device using
separate external 3.3 Vand 1.8 V supplies. Please note that the 1.8 V supply requires de-coupling whether
generated on-chip or externally. Supply voltage selection is done by the pin VSEL.
An additional pin functionality IM1 can be used to select the additional serial interfaces SPI and SCI bus. Because
this ball or pin is used for V
SS in version 2.1, the asynchronous interface (Motorola or Intel) mode is selected for
the QuadFALC
TM Version 3.1 automatically if no change is made on the board (IM1 connected to ground), see
An additional ball or pin READY_EN can be used to activate the output functionality of the additional ball or pin
READY/ DTACK. for the asynchronous micro controller interface. Because the READY_EN ball or pin is used for
V
SS in version 2.1, the ball or pin READY/ DTACK is not active (is in tri-state mode) if no change is made on the
board. Therefore for the READY/ DTACK ball or pin also the board needs not to be changed. See also
Some pins of the micro controller interface have different functions if the SPI or SCI bus is selected as interface
to the micro controller. The functions are unchanged if the asynchronous micro controller interface is selected, see
The balls RLAS2(1:4) of the additional separate analog switches at the receive line interfaces (supported only in
P/PG-LBGA-160-1 package) can be connected to VSSX as for the QuadFALC
V2.1, if the analog switches are
not used.
Because of the integrated serial resistors R
TX in the transmit line interface of the QuadFALC
TM Version 3.1 (see
Chapter 3.7.1) the external transmit resistors R
SER must be changed against that of the Version 3.1.
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PDF描述
PES12-42S-N0024
PESD3V3V4UK,132 25 W, UNIDIRECTIONAL, 4 ELEMENT, SILICON, TVS DIODE
PF38F3050L0YUQ3A SPECIALTY MEMORY CIRCUIT, PBGA88
PFC04108.2UHKT 1 ELEMENT, 8.2 uH, GENERAL PURPOSE INDUCTOR
PFC04101.8UHKT 1 ELEMENT, 1.8 uH, GENERAL PURPOSE INDUCTOR
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參數(shù)描述
PEF22554HT V2.1 制造商:Infineon Technologies AG 功能描述:
PEF22554HTV2.1 功能描述:網(wǎng)絡(luò)控制器與處理器 IC T/E RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
PEF22554H-TV2.1 制造商:Infineon Technologies AG 功能描述:
PEF22554HT-V2.1 制造商:Infineon Technologies AG 功能描述:PEF22554HT-V2.1
PEF22554HTV3.1 功能描述:網(wǎng)絡(luò)控制器與處理器 IC T/E RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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