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參數(shù)資料
| 型號： | MSC7116 |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | Low-Cost 16-bit DSP with DDR Controller and 10/100 Mbps Ethernet MAC |
| 中文描述： | 低成本16位數(shù)字信號處理器與DDR控制器和10/100 Mbps以太網(wǎng)MAC |
| 文件頁數(shù)： | 21/56頁 |
| 文件大?。?/td> | 719K |
| 代理商： | MSC7116 |
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Electrical Characteristics
MSC7116 10/100 Mbps Ethernet MAC Data Sheet, Rev. 11
Freescale Semiconductor
21
2.5
AC Timings
This section presents timing diagrams and specifications for individual signals and parallel I/O outputs and inputs. All AC
timings are based on a 30 pF load, except where noted otherwise, and a 50
Ω
transmission line. For any additional pF, use the
following equations to compute the delay:
— Standard interface: 2.45 + (0.054
×
C
load
) ns
— DDR interface: 1.6 + (0.002
×
C
load
) ns
2.5.1
Clock and Timing Signals
The following tables describe clock signal characteristics.
Table 6
shows the maximum frequency values for internal (core,
reference, and peripherals) and external (
CLKO
) clocks. You must ensure that maximum frequency values are not exceeded (see
Section 2.5.2
for the allowable ranges when using the PLL).
Table 6. Maximum Frequencies
Characteristic
Maximum in MHz
Core clock frequency (CLOCK)
External output clock frequency (CLKO)
Memory clock frequency (CK, CK)
TDM clock frequency (TxRCK, TxTCK)
266
67
133
50
Table 7. Clock Frequencies in MHz
Characteristic
Symbol
Min
Max
CLKIN frequency
F
CLKIN
F
CORE
F
CK
F
TDMCK
F
CKO
F
BCK
10
100
CLOCK frequency
—
266
CK, CK frequency
—
133
TDMxRCK, TDMxTCK frequency
—
50
CLKO frequency
—
67
AHB/IPBus/APB clock frequency
—
133
Note:
The rise and fall time of external clocks should be 5 ns maximum
Table 8. System Clock Parameters
Characteristic
Min
Max
Unit
CLKIN frequency
CLKIN slope
CLKIN frequency jitter (peak-to-peak)
CLKO frequency jitter (peak-to-peak)
10
—
—
—
100
5
1000
133
MHz
ns
ps
ps
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PDF描述 |
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| MSC7118 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Low-Cost 16-bit DSP with DDR Controller |
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