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參數資料
| 型號： | MPC8567VTAUJJ |
| 廠商： | Freescale Semiconductor |
| 文件頁數： | 117/139頁 |
| 文件大?。?/td> | 0K |
| 描述： | MPU POWERQUICC III 1023-PBGA |
| 標準包裝： | 1 |
| 系列： | MPC85xx |
| 處理器類型： | 32-位 MPC85xx PowerQUICC III |
| 速度： | 1.333GHz |
| 電壓： | 1.1V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 1023-BBGA，FCBGA |
| 供應商設備封裝： | 1023-FCPBGA（33x33） |
| 包裝： | 托盤 |
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MPC8568E/MPC8567E PowerQUICC III Integrated Processor Hardware Specifications, Rev. 1
Freescale Semiconductor
79
Serial RapidIO
15.2
AC Requirements for Serial RapidIO SD_REF_CLK and
SD_REF_CLK
Table 50 lists AC requirements.
15.3
Signal Definitions
LP-Serial links use differential signaling. This section defines terms used in the description and
specification of differential signals. Figure 52 shows how the signals are defined. The figures show
waveforms for either a transmitter output (TD and TD) or a receiver input (RD and RD). Each signal
swings between A Volts and B Volts where A > B. Using these waveforms, the definitions are as follows:
7. The transmitter output signals and the receiver input signals TD, TD, RD and RD each have a
peak-to-peak swing of A – B Volts
8. The differential output signal of the transmitter, VOD, is defined as VTD–VTD
9. The differential input signal of the receiver, VID, is defined as VRD-VRD
10. The differential output signal of the transmitter and the differential input signal of the receiver
each range from A – B to –(A – B) Volts
11. The peak value of the differential transmitter output signal and the differential receiver input
signal is A – B Volts
12. The peak-to-peak value of the differential transmitter output signal and the differential receiver
input signal is 2 * (A – B) Volts
Figure 52. Differential Peak-Peak Voltage of Transmitter or Receiver
Table 53. SD_REF_CLK and SD_REF_CLK AC Requirements
Symbol
Parameter Description
Min
Typical
Max
Units
Comments
tREF
REFCLK cycle time
—
10(8)
—
ns
8 ns applies only to serial RapidIO
with 125-MHz reference clock
tREFCJ
REFCLK cycle-to-cycle jitter. Difference in the
period of any two adjacent REFCLK cycles
—
80
ps
—
tREFPJ
Phase jitter. Deviation in edge location with
respect to mean edge location
–40
—
40
ps
—
Differential Peak-Peak = 2 * (A-B)
A Volts
TD or RD
B Volts
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PDF描述 |
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