參數(shù)資料
型號(hào)： MPC8315ECVRAGDA
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 39/106頁(yè)
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描述： MPU POWERQUICC II PRO 620-PBGA
標(biāo)準(zhǔn)包裝： 36
系列： MPC83xx
處理器類(lèi)型： 32-位 MPC83xx PowerQUICC II Pro
速度： 400MHz
電壓： 1V
安裝類(lèi)型： 表面貼裝
封裝/外殼： 620-BBGA 裸露焊盤(pán)
供應(yīng)商設(shè)備封裝： 620-PBGA（29x29）
包裝： 托盤(pán)
MPC8315E PowerQUICC II Pro Processor Hardware Specifications, Rev. 2
38
Freescale Semiconductor
Ethernet: Three-Speed Ethernet, MII Management
Figure 20. SGMII Receiver Input Compliance Mask
Table 38. SGMII Receive AC Timing Specifications
At recommended operating conditions with XCOREVDD = 1.0V ± 5%.
Parameter
Symbol
Min
Typ
Max
Unit
Note
Deterministic Jitter Tolerance
JD
0.37
—
UI p-p
1
Combined Deterministic and Random Jitter Tolerance
JDR
0.55
—
UI p-p
1
Sinusoidal Jitter Tolerance
JSIN
0.1
—
UI p-p
1
Total Jitter Tolerance
JT
0.65
—
UI p-p
1
Bit Error Ratio
BER
—
10-12
—
Unit Interval
UI
799.92
800
800.08
ps
2
AC Coupling Capacitor
CTX
5—
200
nF
3
Note:
1. Measured at receiver.
2. Each UI is 800 ps ± 100 ppm.
3. The external AC coupling capacitor is required. It’s recommended to be placed near the device transmitter outputs.
4. Refer to RapidIOTM 1x/4x LP Serial Physical Layer Specification for interpretation of jitter specifications.
Time (UI)
R
eceiv
e
rDi
ff
e
rential
Inpu
t
V
ol
tag
e
0
0.275
0.4
0.6
0.725
V
RX_DIFFp-p-min/2
VRX_DIFFp-p-min/2
V
RX_DIFFp-p-max/2
VRX_DIFFp-p-max/2
0
1
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PDF描述
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