In fixed arbitration the master with hi" />
參數(shù)資料
型號： MCF5270CVM150R2
廠商： Freescale Semiconductor
文件頁數(shù)： 123/626頁
文件大?。?/td> 0K
描述： IC MCU 32BIT 150MHZ 196-MAPBGA
標(biāo)準(zhǔn)包裝： 750
系列： MCF527x
核心處理器： Coldfire V2
芯體尺寸： 32-位
速度： 150MHz
連通性： EBI/EMI，以太網(wǎng)，I²C，SPI，UART/USART
外圍設(shè)備： DMA，WDT
輸入/輸出數(shù)： 97
程序存儲(chǔ)器類型： ROMless
RAM 容量： 64K x 8
電壓 - 電源 (Vcc/Vdd)： 1.4 V ~ 1.6 V
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 196-LBGA
包裝： 帶卷 (TR)
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Internal Bus Arbitration
MCF5271 Reference Manual, Rev. 2
Freescale Semiconductor
11-11
11.3.2.2 Fixed Mode
In fixed arbitration the master with highest priority (as specified by the MPARK[Mn_PRTY] bits)
will win the bus. That master will relinquish the bus when all transfers to that master are complete.
If MPARK[TIMEOUT] is set, a counter will increment for each master for every cycle it is denied
access. When a counter reaches the limit set by MPARK[LCKOUT_TIME], the arbitration
algorithm will be changed to round-robin arbitration mode until all locks are cleared. The
arbitration will then return to fixed mode and the highest priority master will be granted the bus.
As in round-robin mode, if no masters are requesting, the arbitration pointer will park on the
highest priority master if MPARK[PRK_LAST] is set, or will park on the master which last
requested the bus if cleared.
11.3.3 Bus Master Park Register (MPARK)
The MPARK controls the operation of the system bus arbitration module. The platform bus master
connections are defined as:
Master 3 (M3): Fast Ethernet Controller
Master 2 (M2): 4-channel DMA
Master 1 (M1): Reserved
Master 0 (M0): V2 ColdFire Core
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
16
R
0
0000
M2_P
_EN
0
M3_PRTY
M2_PRTY
M0_PRTY
0
W
Reset
0
1100
0
111000
01
15
14
13
12
11
10
9
8
76543210
R
0
FIXED TIME
OUT
PRK
LAST
LCKOUT_TIME
000000
00
W
Reset
0
0000
0
000000
00
Address
IPSBAR + 0x01C
Figure 11-7. Default Bus Master Park Register (MPARK)
Table 11-6. MPARK Field Description
Bits
Name
Description
31–26
—
Reserved, should be cleared.
25
M2_P_EN DMA bandwidth control enable
0 disable the use of the DMA's bandwidth control to elevate the priority of its bus requests.
1 enable the use of the DMA's bandwidth control to elevate the priority of its bus requests.
相關(guān)PDF資料
PDF描述
VI-B2P-IY-F3 CONVERTER MOD DC/DC 13.8V 50W
VI-B2N-IY-F2 CONVERTER MOD DC/DC 18.5V 50W
MC9328MXLVP20R2 IC MCU I.MX 200MHZ 225-MAPBGA
VI-B2M-IY-F4 CONVERTER MOD DC/DC 10V 50W
MC9328MXLDVP20R2 IC MCU I.MX 200MHZ 225-MAPBGA
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MCF5270VM100 功能描述:微處理器 - MPU MCF5270 V2CORE 64KSRAM RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
MCF5270VM100J 功能描述:32位微控制器 - MCU V2CORE 64KSRAM RoHS:否 制造商:Texas Instruments 核心:C28x 處理器系列:TMS320F28x 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:90 MHz 程序存儲(chǔ)器大小:64 KB 數(shù)據(jù) RAM 大小:26 KB 片上 ADC:Yes 工作電源電壓:2.97 V to 3.63 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:LQFP-80 安裝風(fēng)格:SMD/SMT
MCF5271 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Integrated Microprocessor Hardware Specification
MCF5271_09 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Integrated Microprocessor Hardware Specification
MCF5271CAB100 功能描述:微處理器 - MPU MCF5232 V2CORE 64KSRAM RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
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