參數(shù)資料
型號： MC9328MXSCVP10
廠商： Freescale Semiconductor
文件頁數(shù)： 19/74頁
文件大?。?/td> 0K
描述： IC MCU I.MXS 100MHZ 225-MAPBGA
標準包裝： 160
系列： i.MXS
核心處理器： ARM9
芯體尺寸： 32-位
速度： 100MHz
連通性： EBI/EMI，I²C，SPI，SSI，UART/USART，USB
外圍設(shè)備： DMA，I²S，LCD，POR，PWM，WDT
輸入/輸出數(shù)： 97
程序存儲器類型： ROMless
電壓 - 電源 (Vcc/Vdd)： 1.7 V ~ 3.3 V
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 225-LFBGA
包裝： 托盤
Functional Description and Application Information
MC9328MXS Technical Data, Rev. 3
26
Freescale Semiconductor
4.4.2.2
WAIT Read Cycle DMA Enabled
Figure 7. DTACK WAIT Read Cycle DMA Enabled
Table 14. DTACK WAIT Read Cycle DMA Enabled: WSC = 111111, DTACK_SEL=1, HCLK=96MHz
Number
Characteristic
3.0 ± 0.3 V
Unit
Minimum
Maximum
1OE and EB assertion time
See note 2
–
ns
2CS pulse width
3T
–
ns
3OE negated before CS5 is negated
1.5T-0.68
1.5T-0.06
ns
4
Address inactived before CS negated
–
0.05
ns
5
Wait asserted after CS5 asserted
–
1020T
ns
6Wait asserted to OE negated
2T+1.57
3T+7.33
ns
7
Data hold timing after OE negated
T-1.49
–
ns
8
Data ready after wait is asserted
–
T
ns
9CS deactive to next CS active
T
–
ns
10
OE negate after EB negate
0.06
0.18
ns
11
Wait becomes low after CS5 asserted
0
1019T
ns
RW
WAIT
Address
EB
CS5
OE
(logic high)
DATABUS
programmable
min 0ns
1
2
3
8
9
5
6
7
11
10
12
4
S
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PDF描述
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