參數(shù)資料
型號(hào)： MC9328MXL15
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, 150 MHz, MICROPROCESSOR, PBGA256
封裝： 14 X 14 MM, 1.30 MM HEIGHT, 0.80 MM PITCH, MAPBGA-256
文件頁(yè)數(shù)： 61/84頁(yè)
文件大小： 1492K
代理商： MC9328MXL15
64
MC9328MXL Advance Information
MOTOROLA
Specifications
Active which sets up the status register read. The bank and row addresses are driven during this command.
The third command of the triplet is Read. Bank and column addresses are driven on the address bus during
this command. Data is returned from memory on the low order 8 data bits following the CAS latency.
Figure 53. SDRAM/SyncFlash Read Cycle Timing Diagram
Table 21. SDRAM Timing Parameter Table
Ref
No.
Parameter
1.8V ± 0.10V
3.0V ± 0.30V
Unit
Minimum
Maximum
Minimum
Maximum
1
SDRAM clock high-level width
2.6
—4—
ns
2
SDRAM clock low-level width
6—
4—
ns
3
SDRAM clock cycle time
11.4
—
10
—
ns
3S
CS, RAS, CAS, WE, DQM setup time
3.42
—
3—
ns
SDCLK
CS
CAS
WE
RAS
ADDR
DQ
DQM
ROW/BA
COL/BA
3S
3H
3S
3H
3S
3S
3H
4S
4H
5
3S
3
2
1
8
Data
7
6
相關(guān)PDF資料
PDF描述
MC9328MXL20 32-BIT, 200 MHz, MICROPROCESSOR, PBGA256
MCA2231-SM 1 CHANNEL DARLINGTON OUTPUT OPTOCOUPLER
MCA255-X007T 1 CHANNEL DARLINGTON OUTPUT OPTOCOUPLER
MCA255-X017T 1 CHANNEL DARLINGTON OUTPUT OPTOCOUPLER
MCA255-X019T 1 CHANNEL DARLINGTON OUTPUT OPTOCOUPLER
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參數(shù)描述
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