參數(shù)資料
型號(hào): MB91F467PAPMC-GSE2
廠(chǎng)商: FUJITSU LTD
元件分類(lèi): 微控制器/微處理器
英文描述: RISC MICROCONTROLLER, PQFP176
封裝: 24 X 24 MM, 0.50 MM PITCH, LEAD FREE, PLASTIC, LQFP-176
文件頁(yè)數(shù): 189/200頁(yè)
文件大?。?/td> 6566K
代理商: MB91F467PAPMC-GSE2
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MB91460P Series
DS07-16615-2E
89
5.1.
Data Flash Control and Status Register
This section explains the Data Flash Control and Status register.
DFCS : Data Flash Control and Status register
This bit is cleared by software reset (RST).
Always write 0 to this bit.
These bits control the number of wait cycles for read and write operations.
The bits are set to “111” by software reset (RST) and can be read and written
This bit is cleared by software reset (RST) and can be read and written
Before setting this bit, the user has to take care that no External Bus Chip Select area overlaps the data flash
address space.
Addr:
0x07114
31
30
29
28
27
26
25
24
bit
RDYI
TMG2
TMG1
TMG0
FLASHEN
INTE
RDYINT
RDY
01110001
initial
R/WR/W
R/W0
R
attribute
RDYI
Ready Inversion
0
(default) Normal flash operation
1
Setting this bit to ’1’ activates the RDYI input of the Flash. As a result, the RDY output of
the Flash goes to ’0’ (used for test purposes only). Always write 0 to this bit.
TMG2 TMG1 TMG0
Data Flash Timing Control
CLKB Frequency
up to
CLKB Cycles per
Read Operation
CLKB Cycles per
Write Operation
0
6.2 MHz
3
0
1
16.7 MHz
4
3
0
1
0
33.3 MHz
5
3
0
1
50 MHz
6
3
1
0
66.6 MHz
8
4
1
0
1
83.3 MHz
9
5
1
0
100 MHz
10
6
1
(default) 100 MHz
11
6
FLASHEN
Data Flash Enable
0
(default) Data Flash is disabled and does not accept read and write access
1
Data Flash is enabled and can be read and written depending on data flash security settings.
相關(guān)PDF資料
PDF描述
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MB91F467RCPMC-GSE1 制造商:FUJITSU 功能描述:
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