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418
CHAPTER 16 MULTI-ADDRESS I
2
C
Table 16.4-3 Function of Each Bit in Multi-address I
2
C Clock Control Register (MCCR)
Bit name
Function
Bit 7
DMBP:
Divider m bypass bit
This bit is used to bypass the m divider for generating a shift
clock frequency.
When "0" is written, the value set in CS3 and CS4 becomes
the value of the m divider.
When "1" is written, the m divider is bypassed. This is
equivalent to m = 1.
In read cycle, the present set value can be read.
When n = 0 (CS2 = CS1 = CS0 = 0), do not set this bit.
Bit 6
Unused bit
The read value is undefined.
Writing has no efect on operation.
Bit 5
EN:
Multi-address I
2
C operation
permission bit
This bit permits the operation of the multi-address I
2
C
interface (EN = "1").
When the bit is "0", each bit of the MBSR and MBCR
registers (excluding BER and BEIE bits) is cleared to "0".
When the MBCR:BER bit is set, the bit is cleared.
Bit 4
Bit 3
CS4, CS3:
Clock 1 selection bit
This bit sets shift clock frequency.
Shift clock frequency Fsck is determined by the following
formula.
Bit 2
Bit 1
Bit 0
CS2, CS1, CS0:
Clock 2 selection bit
Where, F
inst
is an instruction cycle (the clock in the SYCC
selected by the SCS bit). When DMBP is "0", m is selected
by CS4 and CS3. When DMBP is "1," m is "1." n is selected
by CS2, CS1, and CS0.
(1)
Fsck =
2/t
(m × n +2)
inst
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