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參數(shù)資料
| 型號： | M30263F8AFP-U9 |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, FLASH, 20 MHz, MICROCONTROLLER, PDSO42 |
| 封裝： | 8.40 X 17.50 MM, 0.80 MM PITCH, LEAD FREE, PLASTIC, SSOP-42 |
| 文件頁數(shù)： | 30/352頁 |
| 文件大小： | 2423K |
| 代理商： | M30263F8AFP-U9 |
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12. Timer
page 111
8
2
3
f
o
5
0
2
,
5
1
.
r
a
M
0
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1
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9
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T
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6
1
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6
1
M
(
p
u
o
r
G
A
6
2
/
C
6
1
M
Timer Bi mode register (i= 0 to 1)
Symbol
Address
After reset
TB0MR to TB1MR
039B16 to 039C16
00XX00002
Bit name
Function
Bit symbol
RW
b7
b6
b5
b4
b3
b2
b1
b0
Operation Mode Select Bit
0 0 : Timer mode or A/D trigger mode
b1 b0
TMOD1
TMOD0
MR0
Invalid in A/D trigger mode
Either "0" or "1" is enabled
MR2
MR1
MR3
0 0 : f1 or f2
0 1 : f8
1 0 : f32
1 1 : fC32
TCK1
TCK0
Count Source Select Bit
(Note 1)
0
TB0MR register
Set to “0” in A/D trigger mode
b7 b6
RW
RO
TB1MR register
Nothing is assigned. When write, set to “0”. When read, its
content is indeterminate
When write in A/D trigger mode, set to “0”. When read in A/D
trigger mode, its content is indeterminate.
Note 1: When this bit is used in delayed trigger mode 0, set the same count source to the timer B0 and timer B1.
Figure 12.2.4.1 TBiMR Register in A/D Trigger Mode
Note 3. When setting the IVPCR1 bit to "1" (three-phase output forcible cutoff by SD pin input enabled), Set the PD8_5
bit to "0" (= input mode).
Note 4. Related pins are U(P80), U(P81), V(P72), V(P73), W(P74), W(P75). After forcible cutoff, input "H" to the P85/NMI/SD pin.
Set the IVPCR1 bit to "0", and this forcible cutoff will be reset. If “L” is input to the P85/NMI/SD pin, a three-phase motor
control timer output will be disabled (INV03=0). At this time, when the IVPCR1 bit is "0", the target pins changes to
programmable I/O port. When the IVPCR1 bit is "1", the target pins changes to high-impedance state regardless of
which functions of those pins are used.
Note 5. When this bit is used in delayed trigger mode 0, set the TB0EN and TB1EN bits to "1"(A/D trigger mode).
Note 6. When setting the TB2SEL bit to "1" (underflow of TB2 interrupt generation frequency setting counter[ICTB2]), Set the INV02
bit to "1" (three-phase motor control timer function).
Note 7. Refer to 16.6 Digital Debounce function for SD input.
PWCOM
Symbol
Address
After reset
TB2SC
039E16
X00000002
Timer B2 Reload Timing
Switch Bit
0 : Timer B2 underflow
1 : Timer A output at odd-numbered
Timer B2 special mode register (Note 1)
Bit name
Function
Bit symbol
b7
b6
b5
b4
b3
b2
b1
b0
IVPCR1
Three-Phase Output Port
SD Control Bit 1
0 : Three-phase output forcible cutoff
by SD pin input (high impedance)
disabled
1 : Three-phase output forcible cutoff
by SD pin input (high impedance)
enabled
Note 1. Write to this register after setting the PRC1 bit in the PRCR register to "1" (write enabled).
Note 2. If the INV11 bit is "0" (three-phase mode 0) or the INV06 bit is "1" (triangular wave modulation mode), set
this bit to "0" (timer B2 underflow).
RW
Nothing is assigned. When write, set to “0”.
When read, its content is “0”.
(b7)
TB2SEL
Trigger Select Bit
0 : TB2 interrupt
1 : Underflow of TB2 interrupt
generation frequency setting counter [ICTB2]
RW
TB0EN
Timer B0 Operation Mode
Select Bit
0 : Other than A/D trigger mode
1 : A/D trigger mode (Note 5)
RW
TB1EN
Timer B1 Operation Mode
Select Bit
0 : Other than A/D trigger mode
1 : A/D trigger mode (Note 5)
RW
(Note 2)
(Note 3, 4, 7)
(Note 6)
(b6-b5)
Reserved bits
Must set to "0"
0
Figure 12.2.4.2 TB2SC Register
相關(guān)PDF資料 |
PDF描述 |
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