參數(shù)資料
型號(hào)： LMX2485_0610
廠商： National Semiconductor Corporation
英文描述： 50 MHz - 3.0 GHz High Performance Delta-Sigma Low Power Dual PLLatinum⑩ Frequency Synthesizers with 800 MHz Integer PLL
中文描述： 50兆赫- 3.0 GHz的高性能Δ-Σ低功耗雙PLLatinum⑩頻率合成器與800兆赫整數(shù)鎖相環(huán)
文件頁(yè)數(shù)： 35/37頁(yè)
文件大小： 881K
代理商： LMX2485_0610
Programming Description
(Continued)
2.7.3 CSR[1:0] -- RF Cycle Slip Reduction
CSR controls the operation of the Cycle Slip Reduction Circuit. This circuit can be used to reduce the occurrence of phase
detector cycle slips. Note that the Fastlock charge pump current, steady state current, and CSR control are all interrelated. Refer
to section 1.8 for information on how to use this.
CSR
0
1
2
3
CSR State
Disabled
Enabled
Enabled
Enabled
Sample Rate Reduction Factor
1
1/2
1/4
1/16
L
www.national.com
35
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PDF描述
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