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參數(shù)資料
| 型號： | ISPPAC-CLK5320S-01TN64I |
| 廠商： | Lattice Semiconductor Corporation |
| 文件頁數(shù)： | 56/56頁 |
| 文件大小： | 0K |
| 描述： | IC BUFFER FANOUT 20OUTPUT 64TQFP |
| 標(biāo)準(zhǔn)包裝： | 160 |
| 系列： | ispClock™ |
| 類型： | 時鐘發(fā)生器，扇出配送，零延遲緩沖器 |
| PLL： | 帶旁路 |
| 輸入： | HSTL，LVCMOS，LVDS，LVPECL，LVTTL，SSTL |
| 輸出： | eHSTL，HSTL，LVCMOS，LVTTL，SSTL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:20 |
| 差分 - 輸入:輸出： | 是/無 |
| 頻率 - 最大： | 267MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 64-LQFP |
| 供應(yīng)商設(shè)備封裝： | 64-TQFP（10x10） |
| 包裝： | 托盤 |
| 其它名稱： | 220-1003 |
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Lattice Semiconductor
ispClock5300S Family Data Sheet
9
Output Rise and Fall Times – Typical Values
1, 2
Output Test Loads
Figures 6 and 7 show the equivalent termination loads used to measure rise/fall times, output timing adders and
other selected parameters as noted in the various tables of this data sheet.
Figure 6. CMOS Termination Load
Figure 7. eHSTL/HSTL/SSTL Termination Load
Output Type
Slew 1 (Fastest)
Slew 2
Slew 3
Slew 4 (Slowest)
Units
tR
tF
tR
tF
tR
tF
tR
tF
LVTTL
0.54
0.76
0.60
0.87
0.78
1.26
1.05
1.88
ns
LVCMOS 1.8V
0.75
0.69
0.88
0.78
0.83
1.11
1.20
1.68
ns
LVCMOS 2.5V
0.57
0.69
0.65
0.78
0.99
0.98
1.65
1.51
ns
LVCMOS 3.3V
0.55
0.77
0.60
0.87
0.78
1.26
1.05
1.88
ns
SSTL18
0.55
0.40
——————
ns
SSTL2
0.50
0.40
——————
ns
SSTL3
0.50
0.45
——————
ns
HSTL
0.60
0.45
——————
ns
eHSTL
0.55
0.40
——————
ns
2. Measured between 20% and 80% points.
ispClock
SCOPE
950Ω
50Ω/3"
50Ω/36"
50Ω 5pF
Zo = 50Ω
ispCLOCK
SCOPE
50Ω/3"
50Ω/36"
950Ω
50Ω 5pF
Zo = HSTL: ~20Ω
SSTL: 40Ω
VTERM
50Ω
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| VE-J10-MZ-S | CONVERTER MOD DC/DC 5V 25W |
| SY100S838LZG | IC CLOCK GEN 3.3V/5V 20-SOIC |
| X9317UM8Z-2.7 | IC XDCP 100TAP 10K 3-WIRE 8-MSOP |
| SY100S834LZG | IC CLOCK GEN 3.3/5V 16-SOIC |
| SY89546UMG TR | IC MUX 4:1 LVDS DIFF 2.5V 32-MLF |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| ISPPACCLK5320S-01TN64I | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:In-System Programmable, Zero-Delay, Universal Fan-Out Buffer, Single-Ended |
| ispPAC-CLK5406D-01SN48C | 功能描述:鎖相環(huán) - PLL 3.3V 6 diff. outputs RoHS:否 制造商:Silicon Labs 類型:PLL Clock Multiplier 電路數(shù)量:1 最大輸入頻率:710 MHz 最小輸入頻率:0.002 MHz 輸出頻率范圍:0.002 MHz to 808 MHz 電源電壓-最大:3.63 V 電源電壓-最小:1.71 V 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:QFN-36 封裝:Tray |
| ispPAC-CLK5406D-01SN48I | 功能描述:鎖相環(huán) - PLL 3.3V 6 diff. outputs RoHS:否 制造商:Silicon Labs 類型:PLL Clock Multiplier 電路數(shù)量:1 最大輸入頻率:710 MHz 最小輸入頻率:0.002 MHz 輸出頻率范圍:0.002 MHz to 808 MHz 電源電壓-最大:3.63 V 電源電壓-最小:1.71 V 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:QFN-36 封裝:Tray |
| ispPAC-CLK5410D-01SN64C | 功能描述:鎖相環(huán) - PLL 3.3V 10 diff. outputs RoHS:否 制造商:Silicon Labs 類型:PLL Clock Multiplier 電路數(shù)量:1 最大輸入頻率:710 MHz 最小輸入頻率:0.002 MHz 輸出頻率范圍:0.002 MHz to 808 MHz 電源電壓-最大:3.63 V 電源電壓-最小:1.71 V 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:QFN-36 封裝:Tray |
| ispPAC-CLK5410D-01SN64I | 功能描述:鎖相環(huán) - PLL 3.3V 10 diff. outputs RoHS:否 制造商:Silicon Labs 類型:PLL Clock Multiplier 電路數(shù)量:1 最大輸入頻率:710 MHz 最小輸入頻率:0.002 MHz 輸出頻率范圍:0.002 MHz to 808 MHz 電源電壓-最大:3.63 V 電源電壓-最小:1.71 V 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:QFN-36 封裝:Tray |
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