Figure 27. Serial Write Timing Diagram Table 39: Write Timing Characteristics in" />
參數(shù)資料
型號： IDT82V3285AEQG
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 101/149頁
文件大?。?/td> 0K
描述： IC PLL WAN SE STRATUM 100TQFP
標準包裝： 90
類型： 時鐘/頻率發(fā)生器，多路復用器
PLL： 是
主要目的： 以太網(wǎng)，SONET/SDH，Stratum
輸入： CMOS，LVDS，PECL
輸出： CMOS，LVDS，PECL
電路數(shù)： 1
比率 - 輸入:輸出： 5:5
差分 - 輸入:輸出： 是/是
頻率 - 最大： 622.08MHz
電源電壓： 3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 100-LQFP 裸露焊盤
供應商設備封裝： 100-TQFP（14x14）
包裝： 托盤
IDT82V3285A
WAN PLL
Microprocessor Interface
55
August 7, 2009
Figure 27. Serial Write Timing Diagram
Table 39: Write Timing Characteristics in Serial Mode
Symbol
Parameter
Min
Typ
Max
Unit
T
One cycle time of the master clock
12.86
ns
tin
Delay of input pad
5
ns
tout
Delay of output pad
5
ns
tsu1
Valid SDI to valid SCLK setup time
4
ns
tsu2
Valid CS to valid SCLK setup time
14
ns
tpw1
SCLK pulse width low
3.5T
ns
tpw2
SCLK pulse width high
3.5T
ns
th1
Valid SDI after valid SCLK hold time
6
ns
th2
Valid CS after valid SCLK hold time
5
ns
tTI
Time between consecutive Write-Write or Write-Read accesses
(CS rising edge to CS falling edge)
10
ns
CS
SCLK
SDI
SDO
High-Z
R/W A0
A1
A2
A3
A4
A5
A6
D0
D1
D2
D3
D4
D5
D6
D7
tsu2
tsu1
th1
th2
tpw2
tpw1
相關PDF資料
PDF描述
IDT82V3285EQG IC PLL WAN SE STRATUM 100TQFP
IDT82V3288BCG IC PLL WAN 3E STRATUM 2 208CABGA
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參數(shù)描述
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