參數(shù)資料
型號: IDT79RC32T333-100DHI
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 10/30頁
文件大?。?/td> 0K
描述: IC MPU 32BIT CORE 100MHZ 208-QFP
產(chǎn)品變化通告: Product Discontinuation 07/Dec/2009
標準包裝: 24
系列: Interprise™
處理器類型: RISC 32-位
速度: 100MHz
電壓: 2.5V
安裝類型: 表面貼裝
封裝/外殼: 208-BFQFP
供應(yīng)商設(shè)備封裝: 208-PQFP(28x28)
包裝: 托盤
其它名稱: 79RC32T333-100DHI
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May 4, 2004
IDT 79RC32333
Reset
mem_addr[19:17]
Tsu10
cpu_coldreset_n rising
10
10
10
ms
Chapter 19,
Figures 19.8 and
19.9
mem_addr[19:17]
Thld10
cpu_coldreset_n rising
1
1
1
ns
mem_addr[22:20]
Tsu22
cpu_masterclk rising
9
7
6
ns
mem_addr[22:20]
Thld22
cpu_masterclk rising
1
1
1
ns
Debug Interface
debug_cpu_dma_n,
debug_cpu_ack_n,
debug_cpu_ads_n,
debug_cpu_i_d_n, ejtag_pcst[2:0]
Tsu20
cpu_coldreset_n rising
10
10
10
ms
debug_cpu_dma_n,
debug_cpu_ack_n,
debug_cpu_ads_n,
debug_cpu_i_d_n, ejtag_pcst[2:0]
Thld20
cpu_coldreset_n rising
1
1
1
ns
Chapter 19,
Figure 19.9 and
Chapter 9,
Figure 9.2
debug_cpu_dma_n,
debug_cpu_ack_n,
debug_cpu_ads_n,
debug_cpu_i_d_n
Tdo20
cpu_masterclk rising
15
12
10
ns
debug_cpu_dma_n,
debug_cpu_ack_n,
debug_cpu_ads_n,
debug_cpu_i_d_n
Tdoh20
cpu_masterclk rising
1
1
1
ns
JTAG Interface
jtag_tms, jtag_tdi, jtag_trst_n
t5
jtag_tck rising
10
10
10
ns
See Figure 4
below.
jtag_tms, jtag_tdi, jtag_trst_n
t6
jtag_tck rising
10
10
10
ns
jtag_tdo
t4
jtag_tck falling
10
10
10
ns
EJTAG Interface
ejtag_tms
t5
jtag_tclk rising
4
4
4
ns
ejtag_tms
t6
jtag_clk rising
2—2—
2—
ns
jtag_tdo Output Delay Time
tTDODO, t4
jtag_tck falling
6—6—
6
ns
See Figure 4
below.
jtag_tdi Input Setup Time
tTDIS, t5
jtag_tck rising
4
4
4
ns
jtag_tdi Input Hold Time
tTDIH, t6
jtag_tck rising
2
2
2
ns
jtag_trst_n Low Time
tTRSTLow, t12
100
100
100
ns
jtag_trst_n Removal Time
tTRSTR, t13
jtag_tck rising
3
3
3
ns
ejtag_tpc Output Delay Time
tTPCDO, t8
ejtag_dclk rising
-1
3
-1
3
-1
3
ns
ejtag_pcst Output Delay Time
tPCSTDO, t7
ejtag_dclk rising
-1
3
-1
3
-1
3
ns
1. At all pipeline frequencies.
2. Guaranteed by design.
3. This PCI interface conforms to the PCI Local Bus Specification, Rev 2.2 at 33MHz.
4. pci_rst_n is tested per PCI 2.2 as an asynchronous signal.
Signal
Symbol
Reference
Edge
RC323331
100MHz
RC323331
133MHz
RC323331
150MHz
Units
User Manual
Timing
Diagram
Reference
Min
Max
Min
Max
Min
Max
Table 6 AC Timing Characteristics - RC32333 (Part 4 of 4)
相關(guān)PDF資料
PDF描述
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IDT70V9189L9PF8 IC SRAM 576KBIT 9NS 100TQFP
0522711069 CONN FFC 10POS 1MM R/A SMD ZIF
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參數(shù)描述
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