參數(shù)資料
型號(hào)： ICS1524
英文描述： Dual Output Phase Controlled SSTL-3/PECL Clock Generator
中文描述： 雙輸出相控SSTL-3/PECL時(shí)鐘發(fā)生器
文件頁(yè)數(shù)： 21/24頁(yè)
文件大?。?/td> 394K
代理商： ICS1524
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ICS1524
ICS1524 Rev C 01/31/2003
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*Note: Measured at 3.6V 0°C, 135-MHz output frequency, PECL clock lines to 75
Οημ
termination, SSTL_3 clock lines
unterminated, 20-pF load. Transition times vary based on termination.
Typical Transition Times*
Output Timing*
REF
PECL CLK-
PECL CLK+
HSYNC
SSTL-CLK
FUNC_OUT
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PECL DPACLK-
PECL DPACLK+
SSTL-DPACLK
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相關(guān)PDF資料
PDF描述
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ICS1524M 制造商:ICS 制造商全稱(chēng):ICS 功能描述:Dual Output Phase Controlled SSTL-3/PECL Clock Generator
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