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參數(shù)資料
| 型號： | HI3026JCQ |
| 廠商： | Intersil |
| 文件頁數(shù)： | 3/17頁 |
| 文件大?。?/td> | 0K |
| 描述： | ADC FLASH 8BIT 120MSPS 48-PQFP |
| 標(biāo)準(zhǔn)包裝： | 60 |
| 位數(shù)： | 8 |
| 采樣率（每秒）： | 120M |
| 數(shù)據(jù)接口： | 并聯(lián) |
| 轉(zhuǎn)換器數(shù)目： | 1 |
| 電壓電源： | 模擬和數(shù)字 |
| 工作溫度： | -20°C ~ 75°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 44-BQFP |
| 供應(yīng)商設(shè)備封裝： | 48-MQFP（12x12） |
| 包裝： | 托盤 |
| 輸入數(shù)目和類型： | 1 個(gè)單端，單極 |
11
Set the SELECT pin to GND for this mode. In this mode, data
output can be obtained in accordance with the clock frequency
applied to the A/D converter for applications which use the
clock applied to the A/D converter as the system clock.
The A/D converter can operate at fC (Min) = 100 MSPS in
this mode.
Digital Input Level and Supply Voltage Settings
The logic input level for the HI3026 supports ECL, PECL and
TTL levels.
The power supplies (DVEE3, DGND3) for the logic input
block must be set to match the logic input (CLK and RESET
signals) level.
TABLE 3. LOGIC INPUT LEVEL AND POWER SUPPLY SETTINGS
DIGITAL
INPUT
LEVEL
DVEE3 DGND3
SUPPLY
VOLTAGE
APPLICATION
CIRCUITS
ECL
-5V
0V
±5V
Figures 18, 21
PECL
0V
+5V
Figures 19, 22
TTL
0V
+5V
Figures 20, 23
FIGURE 9. WHEN THE RESET PULSE IS NOT USED
FIGURE 10. WHEN THE RESET PULSE IS USED
HI3026
CLK
RESETN
A
HI3026
CLK
RESETN
B
8 BITS
CLK
CLKOUT
DATA
CLKOUT
DATA
8 BITS
CLK
HI3026
CLK
RESETN
A
HI3026
CLK
RESETN
B
8 BITS
CLK
CLKOUT
DATA
CLKOUT
DATA
8 BITS
CLK
RESET PULSE
RESET
PULSE
HI3026
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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