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參數(shù)資料
| 型號： | HC05V7GRS |
| 英文描述： | 68HC05V7 General Release Specification |
| 中文描述： | 68HC05V7一般版本規(guī)范 |
| 文件頁數(shù)： | 4/170頁 |
| 文件大?。?/td> | 980K |
| 代理商： | HC05V7GRS |
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MOTOROLA
Page iv
MC68HC05V7 Specification Rev. 1.0
SECTION 4
CPU CORE.....................................................................25
REGISTERS.............................................................................25
ACCUMULATOR (A) ..........................................................25
INDEX REGISTER (X)........................................................25
STACK POINTER (SP).......................................................26
PROGRAM COUNTER (PC) ..............................................26
CONDITION CODE REGISTER (CCR)..............................26
4.1
4.1.1
4.1.2
4.1.3
4.1.4
4.1.5
SECTION 5
INTERRUPTS.................................................................29
CPU INTERRUPT PROCESSING ...........................................29
RESET INTERRUPT SEQUENCE...........................................32
SOFTWARE INTERRUPT (SWI) .............................................32
HARDWARE INTERRUPTS ....................................................32
EXTERNAL INTERRUPT (IRQ)...............................................32
IRQ CONTROL/STATUS REGISTER (ICSR) $1F .............34
EXTERNAL INTERRUPT TIMING......................................36
16-BIT TIMER INTERRUPT.....................................................37
MDLC INTERRUPT..................................................................37
SPI INTERRUPT......................................................................37
8-BIT TIMER INTERRUPT.......................................................38
5.1
5.2
5.3
5.4
5.5
5.5.1
5.5.2
5.6
5.7
5.8
5.9
SECTION 6
RESETS..........................................................................39
EXTERNAL RESET (RESET)..................................................39
INTERNAL RESETS ................................................................40
POWER-ON RESET (POR)................................................40
OPERATION IN STOP AND WAIT.....................................40
COMPUTER OPERATING PROPERLY RESET (COPR)..42
LOW-VOLTAGE RESET (LVR) ..........................................43
ILLEGAL ADDRESS...........................................................44
DISABLED STOP INSTRUCTION......................................44
6.1
6.2
6.2.1
6.2.2
6.2.3
6.2.4
6.2.5
6.2.6
SECTION 7
POWER SUPPLY AND REGULATION........................................45
INTERNAL POWER SUPPLY..................................................45
PRIMARY 5V REGULATOR...............................................45
SECONDARY REGULATOR..............................................45
MISCELLANEOUS REGISTER ...............................................46
IGNS - Ignition status bit.....................................................46
OCE - Output compare enable ...........................................46
PDC - Power Down Control ................................................46
POWER MODING....................................................................47
REGULATOR CONTROL LOGIC ............................................49
MASK OPTIONS.................................................................50
POWER SUPPLY CONFIGURATION .....................................53
DECOUPLING RECOMMENDATIONS..............................53
7.1
7.1.1
7.1.2
7.2
7.2.1
7.2.2
7.2.3
7.3
7.4
7.4.1
7.5
7.5.1
F
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n
.
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