參數(shù)資料
型號： DS33R41+
廠商： Maxim Integrated Products
文件頁數(shù)： 141/335頁
文件大小： 0K
描述： IC TXRX ETHERNET MAP 400-BGA
產(chǎn)品培訓模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 1
類型： 收發(fā)器
驅(qū)動器/接收器數(shù)： 4/4
規(guī)程： T1/E1/J1
電源電壓： 3.14 V ~ 3.47 V
安裝類型： 表面貼裝
封裝/外殼： 400-BBGA
供應商設備封裝： 400-PBGA（27x27）
包裝： 托盤
產(chǎn)品目錄頁面： 1429 (CN2011-ZH PDF)
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DS33R41 Inverse-Multiplexing Ethernet Mapper with Quad Integrated T1/E1/J1 Transceivers
225 of 335
Register Name:
TR.INFO7
Register Description:
Information Register 7 (Real-Time, Non-Latched Register)
Register Address:
30h
Bit #
7
6
5
4
3
2
1
0
Name
CSC5
CSC4
CSC3
CSC2
CSC0
FASSA
CASSA
CRC4SA
Default
0
Bits 7 to 3: CRC4 Sync Counter Bits (CSC5 to CSC2, CSC0).
The CRC4 sync counter increments each time the
8ms CRC4 multiframe search times out. The counter is cleared when the framer has successfully obtained
synchronization at the CRC4 level. The counter can also be cleared by disabling the CRC4 mode (TR.E1RCR1.3 =
0). This counter is useful for determining the amount of time the framer has been searching for synchronization at
the CRC4 level. ITU G.706 suggests that if synchronization at the CRC4 level cannot be obtained within 400ms,
then the search should be abandoned and proper action taken. The CRC4 sync counter rolls over. CSC0 is the
LSB of the 6-bit counter. (Note: The bit next to LSB is not accessible. CSC1 is omitted to allow resolution to
>400ms using 5 bits.) These are read-only, non-latched, real-time bits. It is not necessary to precede the read of
these bits with a write.
Bit 2: FAS Sync Active (FASSA).
Set while the synchronizer is searching for alignment at the FAS level. This is a
read-only, non-latched, real-time bit. It is not necessary to precede the read of this bit with a write.
Bit 1: CAS MF Sync Active (CASSA).
Set while the synchronizer is searching for the CAS MF alignment word.
This is a read-only, non-latched, real-time bit. It is not necessary to precede the read of this bit with a write.
Bit 0: CRC4 MF Sync Active (CRC4SA).
Set while the synchronizer is searching for the CRC4 MF alignment
word. This is a read-only, non-latched, real-time bit. It is not necessary to precede the read of this bit with a write.
Register Name:
TR.H1RC, TR.H2RC
Register Description:
HDLC #1 Receive Control
HDLC #2 Receive Control
Register Address:
31h, 32h
Bit #
7
6
5
4
3
2
1
0
Name
RHR
RHMS
—
RSFD
Default
0
Bit 7: Receive HDLC Reset (RHR).
Resets the receive HDLC controller and flushes the receive FIFO. Must be
cleared and set again for a subsequent reset.
0 = normal operation
1 = reset receive HDLC controller and flush the receive FIFO
Bit 6: Receive HDLC Mapping Select (RHMS)
0 = receive HDLC assigned to channels
1 = receive HDLC assigned to FDL (T1 mode), Sa bits (E1 mode)
Bits 5 to 1: Unused, must be set to 0 or proper operation.
Bit 0: Receive SS7 Fill-In Signal Unit Delete (RSFD)
0 = normal operation; all FISUs are stored in the receive FIFO and reported to the host.
1 = When a consecutive FISU having the same BSN the previous FISU is detected, it is deleted without
host intervention.
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DS33W11+ 功能描述:網(wǎng)絡控制器與處理器 IC Ethernet Over PDH Mapping Devices RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS33W11DK+ 功能描述:以太網(wǎng)開發(fā)工具 1/1 E-Net - PDH Design Kit RoHS:否 制造商:Micrel 產(chǎn)品:Evaluation Boards 類型:Ethernet Transceivers 工具用于評估:KSZ8873RLL 接口類型:RMII 工作電源電壓:
DS33W41+ 功能描述:網(wǎng)絡控制器與處理器 IC Ethernet Over PDH Mapping Devices RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS33X11+ 功能描述:網(wǎng)絡控制器與處理器 IC Ethernet Over PDH Mapping Devices RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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