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參數(shù)資料
| 型號(hào)： | DS32512N# |
| 廠商： | Maxim Integrated Products |
| 文件頁(yè)數(shù)： | 120/130頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC LIU DS3/E3/STS-1 484-BGA |
| 產(chǎn)品培訓(xùn)模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標(biāo)準(zhǔn)包裝： | 60 |
| 類型： | 線路接口裝置（LIU） |
| 規(guī)程： | DS3 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 484-BGA |
| 供應(yīng)商設(shè)備封裝： | 484-BGA（23x23） |
| 包裝： | 管件 |
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DS32506/DS32508/DS32512
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4. DETAILED DESCRIPTION
The DS32506 (6 port), DS32508 (8 port), and DS32512 (12 port) LIUs perform the functions necessary for
interfacing at the physical layer to DS3, E3, or STS-1 lines. Each LIU has independent receive and transmit paths
and a built-in jitter attenuator. The receiver performs clock and data recovery from a B3ZS- or HDB3-coded
alternate mark inversion (AMI) signal and monitors for loss of the incoming signal. The receiver optionally performs
B3ZS/HDB3 decoding and outputs the recovered data in either binary (NRZ) or digital bipolar format. The
transmitter accepts data in either binary (NRZ) or digital bipolar format, optionally performs B3ZS/HDB3 encoding,
and drives standard pulse-shape waveforms onto 75
Ω coaxial cable. Both transmitter and receiver are high-
impedance when VDD is out of spec to enable hot-swappable 1:1 and 1+1 board redundancy without relays. The
jitter attenuator can be mapped into the receiver data path, mapped into the transmitter data path, or disabled. An
on-chip clock adapter generates all line-rate clocks from a single input clock. Control interface options include 8- or
16-bit parallel, SPI, and hardware mode. The DS325xx LIUs conform to the telecommunications standards listed in
Table 1-1. The external components required for proper operation are shown in Figure 4-1 and Figure 4-2.
Figure 4-1. External Connections, Internal Termination Enabled
TXP
TXN
RXP
RXN
1.8V
POWER
PLANE
GROUND
PLANE
TVDD
RVDD
JVDD
TVSS
RVSS
JVSS
0.01μF
0.1μF
1μF
0.01μF
0.1μF
1μF
0.01μF
0.1μF
1μF
1:1
TXP
TXN
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