參數(shù)資料
型號(hào)： DS26324GNA2+
廠商： Maxim Integrated Products
文件頁(yè)數(shù)： 103/120頁(yè)
文件大小： 0K
描述： IC INTERFACE LINE 16CH 256-CSBGA
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 40
類型： 線路接口裝置（LIU）
驅(qū)動(dòng)器/接收器數(shù)： 16/16
規(guī)程： LIN
電源電壓： 3.135 V ~ 3.465 V
安裝類型： 表面貼裝
封裝/外殼： 256-LBGA，CSBGA
供應(yīng)商設(shè)備封裝： 256-CSBGA（17x17）
包裝： 托盤
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DS26324 3.3V, 16-Channel, E1/T1/J1 Short-Haul Line Interface Unit
83 of 120
Register Name:
RDULR
Register Description:
RCLK Disable Upon LOS
Register Address (LIUs 1–8):
16h
Bit #
7
6
5
4
3
2
1
0
Name
RDULR8
RDULR7
RDULR6
RDULR5
RDULR4
RDULR3
RDULR2
RDULR1
Default
0
Register Address (LIUs 9–16):
36h
Bit #
7
6
5
4
3
2
1
0
Name
RDULR16
RDULR15
RDULR14
RDULR13
RDULR12
RDULR11
RDULR10
RDULR9
Default
0
Bits 7 to 0: RCLK Disable Upon LOS Register n (RDULRn). When this bit is set the RCLK for Channel n is
disabled upon a loss of signal and set as a low output. When reset or default RCLK will switch to MCLK upon a
loss of signal within 10ms.
Register Name:
GISC
Register Description:
Global Interrupt Status Control
Register Address:
1Eh
Bit #
7
6
5
4
3
2
1
0
Name
—
INTM
CWE
Default
0
Bit 1: INT Pin Mode (INTM). This bit determines the inactive mode of the
INT pin. The INT pin always drives low
when active.
0 = Pin is high impedance when not active.
1 = Pin drives high when not active.
Bit 0: Clear On Write Enable (CWE). When this bit is set the clear on write is enabled for all the latched interrupt
status registers. The host processor must write a 1 to the latched interrupt status register bit position before the
particular bit will be cleared. Default for all the latched interrupt status registers is to clear on a read.
相關(guān)PDF資料
PDF描述
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