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參數(shù)資料
| 型號： | CY7C1041D-10ZSXC |
| 廠商： | CYPRESS SEMICONDUCTOR CORP |
| 元件分類： | SRAM |
| 英文描述： | 256K X 16 STANDARD SRAM, 10 ns, PDSO44 |
| 封裝： | LEAD FREE, TSOP2-44 |
| 文件頁數(shù)： | 5/9頁 |
| 文件大?。?/td> | 206K |
| 代理商： | CY7C1041D-10ZSXC |
CY7C1041D
PRELIMINARY
Document #: 38-05472 Rev. *B
Page 5 of 9
Read Cycle No. 2 (OE Controlled)
[13, 14]
Write Cycle No. 1 (CE Controlled)
[15, 16]
Notes:
14.Address valid prior to or coincident with CE transition LOW
15.Data I/O is high impedance if OE or BHE and/or BLE= V
.
16.If CE goes HIGH simultaneously with WE going HIGH, the output remains in a high-impedance state.
Switching Waveforms
(continued)
50%
50%
DATA VALID
t
RC
t
ACE
t
DOE
t
LZOE
t
LZCE
t
PU
HIGH IMPEDANCE
t
HZOE
t
HZBE
t
PD
HIGH
OE
CE
ICC
ISB
IMPEDANCE
ADDRESS
DATA OUT
V
CC
SUPPLY
CURRENT
t
DBE
t
LZBE
t
HZCE
BHE, BLE
t
HD
t
SD
t
SCE
t
SA
t
HA
t
AW
t
PWE
t
WC
BW
DATAI/O
ADDRESS
CE
WE
BHE, BLE
t
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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