參數(shù)資料
型號(hào): CS5371A-ISZ
廠商: Cirrus Logic Inc
文件頁(yè)數(shù): 2/32頁(yè)
文件大小: 0K
描述: IC MODULATOR LP/HP 1CH 24-SSOP
標(biāo)準(zhǔn)包裝: 59
類型: 調(diào)制器
分辨率(位): 24 b
采樣率(每秒): 512k
電壓電源: 模擬和數(shù)字
電源電壓: ±2.5V,3.3 V ~ 5 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 24-SSOP(0.209",5.30mm 寬)
供應(yīng)商設(shè)備封裝: 24-SSOP
包裝: 管件
配用: 598-1778-ND - EVALUATION BOARD FOR CS5376
CS5371A CS5372A
10
DS748F3
DIGITAL CHARACTERISTICS (CONT.)
Notes: 20. MCLK is generated by the digital filter. If MCLK is disabled, the device automatically enters a power-
down state.
21. MSYNC is generated by the digital filter and is latched on MCLK falling edge, synchronization instant
(t0) is on the next MCLK rising edge.
22. Decimated, filtered, and offset-corrected 24-bit output word from the digital filter.
Parameter
Symbol
Min
Typ
Max
Unit
Master Clock Input
MCLK Frequency
-2.048
-
MHz
MCLK Period
-488
-
ns
MCLK Duty Cycle
(Note 9)MCLKDC
40
-
60
%
MCLK Rise Time
--
50
ns
MCLK Fall Time
--
50
ns
MCLK Jitter (in-band or aliased in-band)
(Note 9)MCLKIBJ
--
300
ps
MCLK Jitter (out-of-band)
(Note 9)MCLKOBJ
--
1
ns
Master Sync Input
MSYNC Setup Time to MCLK Falling
20
122
-
ns
MSYNC Period
40
976
-
ns
MSYNC Hold Time after MCLK Falling
20
122
-
ns
MDATA Output
MDATA Output Bit Rate
fmdata
-
512
-
kbits/s
MDATA Output Bit Period
tmdata
-
1953
-
ns
MDATA Output One’s Density Range
(Note 9)MDATOD
14
-
86
%
Full-scale Output Code
0xA2EBE0
-
0x5D1420
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PDF描述
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參數(shù)描述
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CS5371-BS 功能描述:模數(shù)轉(zhuǎn)換器 - ADC LP High Performance Delta Sigma Mod. RoHS:否 制造商:Texas Instruments 通道數(shù)量:2 結(jié)構(gòu):Sigma-Delta 轉(zhuǎn)換速率:125 SPs to 8 KSPs 分辨率:24 bit 輸入類型:Differential 信噪比:107 dB 接口類型:SPI 工作電源電壓:1.7 V to 3.6 V, 2.7 V to 5.25 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:VQFN-32
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