VREF+ _ Positive Voltage Reference Input, pin 5 Input" />
參數(shù)資料
型號(hào)： CS5371A-ISZ
廠商： Cirrus Logic Inc
文件頁(yè)數(shù)： 19/32頁(yè)
文件大?。?/td> 0K
描述： IC MODULATOR LP/HP 1CH 24-SSOP
標(biāo)準(zhǔn)包裝： 59
類型： 調(diào)制器
分辨率（位）： 24 b
采樣率（每秒）： 512k
電壓電源： 模擬和數(shù)字
電源電壓： ±2.5V，3.3 V ~ 5 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 24-SSOP（0.209"，5.30mm 寬）
供應(yīng)商設(shè)備封裝： 24-SSOP
包裝： 管件
配用： 598-1778-ND - EVALUATION BOARD FOR CS5376
CS5371A CS5372A
26
DS748F3
VREF+ _ Positive Voltage Reference Input, pin 5
Input for an external +2.500 V voltage reference relative to VREF-.
VREF- _ Negative Voltage Reference Input, pin 6
This pin should be tied to VA- near the voltage reference output.
Digital Inputs
MCLK _ Modulator Clock Input, pin 19
A CMOS compatible clock input for the modulator internal master clock, nominally 2.048 MHz
with an amplitude equal to the VD digital power supply.
MSYNC _ Modulator Sync Input, pin 20
A low to high transition resets the internal clock phasing of the modulator. This assures the
sampling instant and modulator data output are synchronous to the external system.
OFST _ Offset Mode Select, pin 14
When high, adds approximately -60 mV or -35 mV of internal differential offset to the analog
input signal to guarantee any
ΔΣ idle tones are removed. When low, no offset is added.
PWDN _ Power-down Mode, pin 24
When high, the modulator is in power-down mode. Halting MCLK while in power down mode
reduces modulator power dissipation further.
Digital Outputs
MDATA _ Modulator Data Output, pin 21
Modulator data is output as a 1-bit serial data stream at 512 kHz with an MCLK input of
2.048 MHz.
MFLAG _ Modulator Flag Output, pin 22
A high level output indicates the modulator is unstable due to an over-range on the analog
inputs.
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PDF描述
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參數(shù)描述
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