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參數(shù)資料
| 型號(hào)： | C166SV2 |
| 英文描述： | POWER SCHOTTKY RECTIFIER |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 71/438頁 |
| 文件大小： | 5402K |
| 代理商： | C166SV2 |
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User Manual
C166S V2
Central Processing Unit
User Manual
2-71
V 1.7, 2001-01
C166S V2 CPU features instructions that provide direct access to two operands in the
bit addressable space without requiring them to be moved to temporary locations.
The same logical instructions that are available for words and bytes can also be used for
bits. The user can compare and modify a control bit for a peripheral in one instruction.
Multiple bit shift instructions have been included to avoid long instruction streams of
single bit shift operations. These instruction require a single CPU cycle. Additionally, bit
field instructions enable are able
to modify the multiple bits in one operand in a single
instruction.
All instructions that manipulate single bits or bit groups internally use a read-modify-write
sequence that accesses the whole word containing the specified bit(s).
This method has several consequences:
Bits can be modified only within the internal address areas, i.e. internal RAM and
SFRs. External locations cannot be used with bit instructions.
The upper 256 bytes of the SFR area, the ESFR area, and the internal RAM are bit
addressable, i.e. those register bits located within the respective sections can be directly
manipulated using bit instructions. The other SFRs must be accessed byte/word wise.
Note: All GPRs are bit addressable independent of the allocation of the register bank via
the Context Pointer (CP). Even GPRs allocated to not bit addressable RAM
locations provide this feature.
The read-modify-write approach may be critical with hardware-effected bits. In such
cases, the hardware may change specific bits while the read-modify-write operation is
in progress, where the write back would overwrite the new bit value generated by the
hardware. The solution is either the implemented hardware protection (see below) or
realized through special programming (see
Section 4.1
).
Protected bits
are not changed during the read-modify-write sequence, that is, when
hardware sets something like an interrupt request flag between the read and the write of
the read-modify-write sequence. The hardware protection logic guarantees that only the
intended bit(s) is/are effected by the write-back operation.
Note: If a conflict occurs between a bit manipulation generated by hardware and an
intended software access, the software access has priority and determines the
final value of the respective bit.
2.6.5
Multiply and Divide Unit
The C166S V2 CPU multiply and divide unit has two separated parts. One is the fast
16x16-bit multiplier that executes a multiplication in one CPU cycle. The other one is a
division sub-unit which performs the division algorithm in 21 CPU cycles maximum.
According to the data and division types, the division length varies between 18 and 21
cycles. The divide instruction requires four CPU cycles to be executed. For performance
reasons, the rest of the division algorithm runs in the background during the following
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| C16R5 | POWER SCHOTTKY RECTIFIER |
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| C1670A.18.10 | 功能描述:2P/22AWG STC OA SHIELD 500' RoHS:是 類別:線纜，導(dǎo)線 >> 多芯導(dǎo)線 系列:- 標(biāo)準(zhǔn)包裝:1 系列:- 纜線類型:多芯 導(dǎo)線數(shù):4 線規(guī):12 AWG 線束:65 股 / 30 AWG 導(dǎo)線材料:裸銅 套管類型:Carolprene 套管直徑:0.475"（12.07mm） 屏蔽類型:- 長(zhǎng)度:250'（76.2m） 額定值:- 特點(diǎn):- 顏色:黃 電壓:300V 工作溫度:-40°C ~ 90°C 使用:- 線芯絕緣:- 套管（絕緣體）厚度:0.030"（0.76mm） 屏蔽材料:- 屏蔽覆蓋范圍:- |
| C1670A.30.10 | 功能描述:2P/22 STC OA SH TYPE CM RoHS:是 類別:線纜，導(dǎo)線 >> 多芯導(dǎo)線 系列:- 標(biāo)準(zhǔn)包裝:1 系列:- 纜線類型:多芯 導(dǎo)線數(shù):4 線規(guī):12 AWG 線束:65 股 / 30 AWG 導(dǎo)線材料:裸銅 套管類型:Carolprene 套管直徑:0.475"（12.07mm） 屏蔽類型:- 長(zhǎng)度:250'（76.2m） 額定值:- 特點(diǎn):- 顏色:黃 電壓:300V 工作溫度:-40°C ~ 90°C 使用:- 線芯絕緣:- 套管（絕緣體）厚度:0.030"（0.76mm） 屏蔽材料:- 屏蔽覆蓋范圍:- |
| C1670A.41.10 | 功能描述:2P/22AWG STC OA SHIELD 1000' RoHS:是 類別:線纜，導(dǎo)線 >> 多芯導(dǎo)線 系列:- 標(biāo)準(zhǔn)包裝:1 系列:* |
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