參數(shù)資料
型號： AT90S2313-10PC
廠商： Atmel
文件頁數(shù)： 72/92頁
文件大小： 0K
描述： IC MCU 2K FLSH 10MHZ UART 20DIP
標準包裝： 18
系列： AVR® 90S
核心處理器： AVR
芯體尺寸： 8-位
速度： 10MHz
連通性： SPI，UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 15
程序存儲器容量： 2KB（1K x 16）
程序存儲器類型： 閃存
EEPROM 大?。?/td> 128 x 8
RAM 容量： 128 x 8
電壓 - 電源 (Vcc/Vdd)： 4 V ~ 6 V
振蕩器型： 外部
工作溫度： 0°C ~ 70°C
封裝/外殼： 20-DIP（0.300"，7.62mm）
包裝： 管件
PIC16C6X
DS30234D-page 74
1997 Microchip Technology Inc.
8.5
Resetting Timer1 using a CCP Trigger
Output
CCP2 is implemented on the PIC16C63/R63/65/65A/
R65/66/67 only.
If CCP1 or CCP2 module is congured in Compare
mode
to
generate
a
“special
event
trigger”
(CCPxM3:CCPxM0 = 1011), this signal will reset
Timer1.
Timer1 must be congured for either timer or synchro-
nized counter mode to take advantage of this feature.
If the Timer1 is running in asynchronous counter mode,
this reset operation may not work.
In the event that a write to Timer1 coincides with a spe-
cial event trigger from CCP1 or CCP2, the write will
take precedence.
In this mode of operation, the CCPRxH:CCPRxL regis-
ters pair effectively becomes the period register for the
Timer1 module.
Applicable Devices
61 62 62A R62 63 R63 64 64A R64 65 65A R65 66 67
Note:
The “special
event
trigger” from
the
CCP1and CCP2 modules will not set inter-
rupt ag bit TMR1IF(PIR1<0>).
8.6
Resetting of TMR1 Register Pair
(TMR1H:TMR1L)
The TMR1H and TMR1L registers are not reset to 00h
on a POR or any other reset except by the CCP1 or
CCP2 special event trigger.
The T1CON register is reset to 00h on a Power-on
Reset or a Brown-out Reset, which shuts off the timer
and leaves a 1:1 prescaler. In all other resets, the reg-
ister is unaffected.
8.7
Timer1 Prescaler
The prescaler counter is cleared on writes to the
TMR1H or TMR1L registers.
Applicable Devices
61 62 62A R62 63 R63 64 64A R64 65 65A R65 66 67
Applicable Devices
61 62 62A R62 63 R63 64 64A R64 65 65A R65 66 67
TABLE 8-2:
REGISTERS ASSOCIATED WITH TIMER1 AS A TIMER/COUNTER
Address
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Value on:
POR,
BOR
Value on
all other
resets
0Bh,8Bh
10Bh,18Bh
INTCON
GIE
PEIE
T0IE
INTE
RBIE
T0IF
INTF
RBIF
0000 000x 0000 000u
0Ch
PIR1
PSPIF(2)
(3)
RCIF(1)
TXIF(1)
SSPIF
CCP1IF
TMR2IF
TMR1IF 0000 0000 0000 0000
8Ch
PIE1
PSPIE(2)
(3)
RCIE(1)
TXIE(1)
SSPIE
CCP1IE TMR2IE
TMR1IE 0000 0000 0000 0000
0Eh
TMR1L
Holding register for the Least Signicant Byte of the 16-bit TMR1 register
xxxx xxxx uuuu uuuu
0Fh
TMR1H
Holding register for the Most Signicant Byte of the 16-bit TMR1 register
xxxx xxxx uuuu uuuu
10h
T1CON
—
T1CKPS1 T1CKPS0 T1OSCEN T1SYNC TMR1CS TMR1ON --00 0000 --uu uuuu
Legend: x = unknown, u = unchanged, - = unimplemented read as '0'. Shaded cells are not used by the Timer1 module.
Note 1:
The USART is implemented on the PIC16C63/R63/65/65A/R65/66/67 only.
2:
Bits PSPIE and PSPIF are reserved on the PIC16C62/62A/R62/63/R63/66, always maintain these bits clear.
3:
PIR1<6> and PIE1<6> are reserved, always maintain these bits clear.
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