參數資料
| 型號： | AGLP060V5-CSG289I |
| 廠商： | Microsemi SoC |
| 文件頁數： | 56/134頁 |
| 文件大小： | 0K |
| 描述： | IC FPGA IGLOO PLUS 60K 289-CSP |
| 標準包裝： | 152 |
| 系列： | IGLOO PLUS |
| 邏輯元件/單元數： | 1584 |
| RAM 位總計： | 18432 |
| 輸入/輸出數： | 157 |
| 門數： | 60000 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 289-TFBGA，CSBGA |
| 供應商設備封裝： | 289-CSP（14x14） |
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IGLOO PLUS DC and Switching Characteristics
2-14
Revision 16
PLL Contribution—PPLL
PPLL = PDC4 + PAC13 *FCLKOUT
FCLKOUT is the output clock frequency.1
Guidelines
Toggle Rate Definition
A toggle rate defines the frequency of a net or logic element relative to a clock. It is a percentage. If the
toggle rate of a net is 100%, this means that this net switches at half the clock frequency. Below are
some examples:
The average toggle rate of a shift register is 100% because all flip-flop outputs toggle at half of the
clock frequency.
The average toggle rate of an 8-bit counter is 25%:
– Bit 0 (LSB) = 100%
– Bit 1
= 50%
– Bit 2
= 25%
–…
– Bit 7 (MSB) = 0.78125%
– Average toggle rate = (100% + 50% + 25% + 12.5% + . . . + 0.78125%) / 8
Enable Rate Definition
Output enable rate is the average percentage of time during which tristate outputs are enabled. When
nontristate output buffers are used, the enable rate should be 100%.
1. If a PLL is used to generate more than one output clock, include each output clock in the formula by adding its corresponding
contribution (PAC13* FCLKOUT product) to the total PLL contribution.
Table 2-19 Toggle Rate Guidelines Recommended for Power Calculation
Component
Definition
Guideline
1
Toggle rate of VersaTile outputs
10%
2
I/O buffer toggle rate
10%
Table 2-20 Enable Rate Guidelines Recommended for Power Calculation
Component
Definition
Guideline
1
I/O output buffer enable rate
100%
2
RAM enable rate for read operations
12.5%
3
RAM enable rate for write operations
12.5%
相關PDF資料 |
PDF描述 |
|---|---|
| AGLP060V5-CS289I | IC FPGA IGLOO PLUS 60K 289-CSP |
| HMC36DRYH-S734 | CONN EDGECARD 72POS DIP .100 SLD |
| AMC31DRTI | CONN EDGECARD 62POS .100 DIP SLD |
| AMC31DREI | CONN EDGECARD 62POS .100 EYELET |
| EMC50DRYS-S93 | CONN EDGECARD 100PS DIP .100 SLD |
相關代理商/技術參數 |
參數描述 |
|---|---|
| AGLP060-V5CSG289PP | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:IGLOO PLUS Low-Power Flash FPGAs with FlashFreeze Technology |
| AGLP060-V5FCS289 | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:IGLOO PLUS Low-Power Flash FPGAs with FlashFreeze Technology |
| AGLP060V5-FCS289 | 制造商:Microsemi Corporation 功能描述:FPGA IGLOO PLUS 60K GATES 512 CELLS 130NM 1.5V 289CSP - Trays |
| AGLP060-V5FCS289ES | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:IGLOO PLUS Low-Power Flash FPGAs with FlashFreeze Technology |
| AGLP060-V5FCS289I | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:IGLOO PLUS Low-Power Flash FPGAs with FlashFreeze Technology |
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